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应用于SoC的PCIE与FC协议高速信息传输模块实现与验证

摘要第5-6页
ABSTRACT第6页
符号对照表第10-11页
缩略语对照表第11-15页
第一章 绪论第15-21页
    1.1 研究背景及意义第15页
    1.2 PCIe的发展历史背景第15-17页
    1.3 PCIe的技术优势第17-18页
    1.4 PCIe的发展和应用前景第18-19页
    1.5 本文的研究内容第19-21页
第二章 PCIe系统体系结构第21-29页
    2.1 PCIe简介第21页
    2.2 PCIe链路第21-23页
    2.3 PCIe拓扑结构第23-25页
    2.4 PCIe系统模块结构第25-28页
        2.4.1 基于X86的PCIe体系结构第25-26页
        2.4.2 基于PowerPC的PCIe体系结构第26-28页
    2.5 本章小结第28-29页
第三章 协议介绍及PCIe物理层分析第29-41页
    3.1 FC协议第29-33页
        3.1.1 FC层描述第29-30页
        3.1.2 FC协议拓扑方式第30-33页
    3.2 PCIE协议第33-39页
        3.2.1 事务层第33页
        3.2.2 数据链路层第33页
        3.2.3 物理层第33-36页
        3.2.4 链路训练第36-39页
    3.3 本章小结第39-41页
第四章 高速信息传输模块的具体实现第41-61页
    4.1 概述第41-43页
    4.2 PCIe PHY第43页
    4.3 PCIe核第43-46页
        4.3.1 PCIe核的层次结构第44页
        4.3.2 PCIe核的操作处理第44-45页
        4.3.3 PCIe核的buffer设定第45-46页
        4.3.4 PCIe核的特性第46页
    4.4 DMA核第46-52页
        4.4.1 Target模块第46-49页
        4.4.2 配置管理模块第49页
        4.4.3 DMA数据接口引擎模块第49-51页
        4.4.4 Completion Monitor模块第51页
        4.4.5 发送接收仲裁模块第51页
        4.4.6 DMA核主要特性第51-52页
    4.5 用户逻辑设计第52-58页
        4.5.1 操作原理即实现第53-54页
        4.5.2 FLASH接口模块第54-55页
        4.5.3 寄存器接口模块第55页
        4.5.4 信息交互区接口模块第55-56页
        4.5.5 长消息发送接收模块第56-57页
        4.5.6 短消息发送接收模块第57页
        4.5.7 用户逻辑特性第57-58页
    4.6 PCIe后端DMA多请求加权优先级仲裁电路第58-59页
        4.6.1 原有仲裁方法分析第58页
        4.6.2 改进技术方案第58-59页
    4.7 本章小结第59-61页
第五章 高速传输模块验证第61-75页
    5.1 验证方法及验证流程第61-66页
        5.1.1 功能验证介绍第61-62页
        5.1.2 软硬件协同验证第62页
        5.1.3 验证流程第62-63页
        5.1.4 验证环境及其相关工具第63页
        5.1.5 验证平台的搭建第63-66页
        5.1.6 验证项规划第66页
    5.2 验证结果分析第66-70页
        5.2.1 主机可访问寄存器读写验证第67-68页
        5.2.2 信息交互区的访问第68-69页
        5.2.3 FLASH访问验证第69-70页
    5.3 FPGA验证第70-72页
        5.3.1 验证原理第71页
        5.3.2 典型验证项MSI中断验证分析第71-72页
    5.4 后仿真验证第72-74页
    5.5 本章小结第74-75页
第六章 总结与展望第75-77页
    6.1 总结第75-76页
    6.2 未来展望第76-77页
参考文献第77-79页
致谢第79-81页
作者简介第81-82页

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