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等离子工艺引起的栅氧化膜充电损伤机理研究

摘要第1-7页
Abstract第7-9页
第一章 绪论第9-12页
   ·引言第9-11页
   ·本文研究内容第11-12页
第二章 VLSI技术中的等离子体损伤第12-32页
   ·等离子体及其在IC制造中的应用第12-17页
   ·薄栅氧化层的失效和击穿第17-23页
   ·等离子损伤的危害第23-28页
   ·常见的等离子损伤失效机理第28-32页
第三章 等离子损伤的测试结构及测试方法的研究第32-47页
   ·等离子损伤测试结构的研究第32-38页
   ·等离子损伤测试方法的研究第38-47页
第四章 0.18μm CMOS工艺中的各种等离子损伤评估第47-52页
   ·多晶硅刻蚀和ILD淀积的损伤第47-48页
   ·金属层间介质干法刻蚀的损伤第48-49页
   ·金属刻蚀的等离子损伤第49-50页
   ·IMD淀积的等离子损伤第50-51页
   ·Cover工艺的等离子损伤第51-52页
第五章 HDP淀积中的PID机理研究及改善第52-64页
   ·HDP淀积引入损伤的相关研究第52-53页
   ·充电电流极性和损伤位置的讨论第53-56页
   ·损伤机理的分析第56-60页
   ·实验改进第60-64页
参考文献第64-68页
致谢第68-69页
攻读学位期间发表的学术论文目录第69页

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