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10Gb/s低功耗时钟数据恢复电路设计

摘要第5-7页
ABSTRACT第7-8页
符号对照表第12-13页
缩略语对照表第13-16页
第一章 绪论第16-22页
    1.1 课题研究与研究背景第16-17页
    1.2 CDR研究现状及趋势第17-18页
    1.3 本文主要研究内容第18-19页
    1.4 论文组织结构第19-22页
第二章 时钟数据恢复电路的理论基础第22-34页
    2.1 功能及原理第22-23页
    2.2 指标第23-30页
        2.2.1 时钟抖动第23-29页
        2.2.2 抖动传输第29页
        2.2.3 抖动容限第29页
        2.2.4 抖动产生第29-30页
    2.3 基本结构第30-33页
        2.3.1 基于二类锁相环的CDR电路第30-32页
        2.3.2 基于延时相位锁定的CDR电路第32页
        2.3.3 基于相位插值/相位选择的CDR电路第32-33页
    2.4 本章小结第33-34页
第三章 时钟数据恢复电路设计第34-66页
    3.1 整体设计第34-36页
    3.2 各模块设计第36-66页
        3.2.1 鉴相器模块设计第36-50页
        3.2.2 电压电流转换电路设计第50-54页
        3.2.3 压控振荡器电路设计第54-61页
        3.2.4 串并转换电路设计第61-66页
第四章 电路版图设计第66-72页
    4.1 电路各模块版图设计第66页
    4.2 鉴相器设计第66-68页
    4.3 VI转换第68页
    4.4 VCO+VCO缓冲器第68-69页
    4.5 串并转换第69-71页
    4.6 CDR环路第71-72页
第五章 时钟数据恢复电路仿真第72-80页
    5.1 随机噪声仿真第72页
    5.2 TT corner/0.9V/65°第72-74页
    5.3 SS corner/0.855V/125°第74-76页
    5.4 FF corner/0.945V/-40°第76-80页
第六章 总结与展望第80-82页
参考文献第82-86页
致谢第86-88页
作者简介第88页

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