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应用于LVDS高速接口的低抖动锁相环的研究与设计

摘要第4-5页
Abstract第5页
第1章 绪论第9-13页
    1.1 课题的背景及意义第9-10页
    1.2 国内外研究现状第10-11页
    1.3 论文研究内容第11页
    1.4 论文的结构安排第11-13页
第2章 锁相环电路的基本理论第13-23页
    2.1 锁相环的基本结构及组成模块第13-18页
        2.1.1 鉴频鉴相器(PFD)第14-15页
        2.1.2 电荷泵(CP)第15-16页
        2.1.3 环路滤波器(LPF)第16-17页
        2.1.4 压控振荡器第17-18页
        2.1.5 分频器第18页
    2.2 锁相环环路传输函数及稳定性分析第18-19页
    2.3 锁相环环路参数的定义与推导第19-21页
    2.4 本章小结第21-23页
第3章 锁相环噪声分析第23-33页
    3.1 时间抖动和相位噪声第23-25页
        3.1.1 时间抖动第23-24页
            3.1.1.1 确定性抖动第23-24页
            3.1.1.2 随机性抖动第24页
        3.1.2 相位噪声第24-25页
        3.1.3 时间抖动和相位噪声的换算关系第25页
    3.2 锁相环系统的相位噪声分析第25-31页
        3.2.1 输入参考时钟噪声第26页
        3.2.2 鉴频鉴相器和电荷泵噪声第26-27页
        3.2.3 环路滤波器噪声第27-28页
        3.2.4 振荡器中的相位噪声第28-29页
        3.2.5 分频器的噪声第29页
        3.2.6 其他噪声第29页
        3.2.7 锁相环各噪声源的传递函数第29-31页
    3.3 抑制抖动的方法第31页
    3.4 本章小结第31-33页
第4章 锁相环的系统设计第33-39页
    4.1 锁相环设计流程第33页
    4.2 锁相环环路参数设计第33-35页
        4.2.1 设计指标要求第33-34页
        4.2.2 环路参数设计第34-35页
    4.3 锁相环行为级建模与仿真第35-36页
    4.4 电荷泵锁相环模块确定第36-37页
    4.5 本章小结第37-39页
第5章 锁相环的电路设计第39-55页
    5.1 鉴频鉴相器的设计与仿真第39-42页
        5.1.1 传统鉴频鉴相器结构第39-40页
        5.1.2 改进的鉴频鉴相器结构第40-41页
        5.1.3 改进的鉴频鉴相器仿真结果第41-42页
    5.2 电荷泵电路的设计与仿真第42-45页
        5.2.1 传统的电荷泵结构第42-43页
        5.2.2 改进的的电荷泵结构第43-44页
        5.2.3 改进的电荷泵仿真结果第44-45页
    5.3 环路滤波器的设计与仿真第45-48页
        5.3.1 常用的环路滤波器结构第45-46页
        5.3.2 环路滤波器结构第46-48页
    5.4 环形振荡器的设计与仿真第48-51页
        5.4.1 传统的环形振荡器结构第48-49页
        5.4.2 改进的环形振荡器结构第49页
        5.4.3 改进的环形振荡器仿真结果第49-51页
    5.5 分频器的设计第51-52页
        5.5.1 分频器的电路设计第51-52页
        5.5.2 分频器的仿真结果第52页
    5.6 低压差线性稳压器(LDO)的设计第52-54页
    5.7 本章小结第54-55页
第6章 版图设计及后仿真验证第55-65页
    6.1 工艺制造对版图设计的要求第55-56页
    6.2 版图设计中引入的非理想效应第56-59页
        6.2.1 串扰第56-57页
        6.2.2 失配第57-58页
        6.2.3 噪声第58-59页
    6.3 电荷泵锁相环版图设计第59-61页
    6.4 锁相环的整体性能仿真第61-63页
    6.5 本章小结第63-65页
结论第65-67页
参考文献第67-71页
攻读硕士学位期间所发表的学术论文第71-73页
致谢第73页

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