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应用于超声成像的数据采集与卷积处理硬件系统

摘要第1-5页
Abstract第5-10页
第1章 绪论第10-16页
   ·医学超声成像简介第10-12页
   ·课题背景第12-13页
   ·主要研究工作第13-14页
   ·论文内容安排第14-16页
第2章 FPGA 在设计中的作用第16-24页
   ·FPGA 的基本硬件资源第16-20页
     ·可编程逻辑块(Configurable Logic Blocks, CLB)第16-17页
     ·输入输出端口模块(Input/Output Blocks, IOB)第17-18页
     ·块状RAM(Block RAM)第18-19页
     ·数字时钟管理(Digital Clock Manager, DCM)与时钟资源第19-20页
   ·FPGA 在高速数据采集系统中的作用第20-21页
   ·数字信号处理的硬件实现基础第21-24页
     ·传统DSP 的算法实现与FPGA 算法硬件实现的比较第21页
     ·FPGA 硬件实现的方法第21-24页
第3章 高速数据采集系统实现——板级电路设计第24-36页
   ·AD 采样电路设计第25-28页
     ·AD9228 芯片介绍第25-27页
     ·模拟差分输入第27-28页
     ·电源与接地的设计第28页
   ·SRAM 缓存电路设计第28-30页
     ·SRAM 芯片介绍第28-29页
     ·缓存电路设计第29-30页
   ·FPGA 板级电路设计第30-32页
     ·FPGA 的bank第30-31页
     ·LVDS 的差分接入第31-32页
     ·FPGA 的供电第32页
     ·FPGA 的时钟接入和JTAG 电路第32页
   ·板级电路设计整体回顾第32-36页
第4章 高速数据采集系统实现——FPGA 逻辑电路设计第36-56页
   ·FPGA 设计工具介绍第36-40页
     ·ISE第36-37页
     ·PlanAhead第37-39页
     ·iMPACT第39-40页
   ·AD 采样接收电路第40-43页
     ·接收LVDS 信号第40-41页
     ·串并转换第41-42页
     ·采样电路测试与测试结果第42-43页
   ·SRAM 读写控制电路第43-45页
     ·SRAM 读写控制模块第43-44页
     ·SRAM 读写测试与测试结果第44-45页
   ·整体测试方案与测试结果第45-49页
     ·直接相接但各自独立第45-46页
     ·共用时钟第46-47页
     ·数据时钟同时连接第47-48页
     ·统一时钟第48-49页
   ·最终的测试结果与讨论第49-56页
     ·最终测试结果第50-51页
     ·关于约束的讨论第51-54页
     ·关于设计方案改进的探讨第54-56页
第5章 卷积的FPGA 硬件实现第56-86页
   ·引言第56-57页
   ·常用卷积硬件实现方法的讨论第57-60页
     ·FIR 滤波器直接型实现方式第57-58页
     ·直接型FIR 滤波器的加法树形实现结构第58-59页
     ·FIR 滤波器的转置结构第59页
     ·添加延迟寄存器的直接型FIR 滤波器结构第59-60页
   ·卷积基本多级乘加结构的具体实现第60-67页
     ·所使用的FPGA 芯片平台第60-61页
     ·DSP48 硬核模块第61-65页
     ·卷积的二级流水线方案实测第65-67页
   ·卷积的拆分与拼接第67-76页
     ·卷积拆分与拼接的思路和计算量讨论第67-68页
     ·卷积阶数的确定第68-69页
     ·关于流水线延迟影响的讨论第69-70页
     ·拆分的硬件电路实现第70-72页
     ·拼接的硬件电路实现第72-74页
     ·整体测试第74-76页
   ·改进方案的讨论第76-85页
     ·重叠流水线第76-78页
     ·更换结构第78-81页
     ·32 阶运算测试第81-85页
   ·总结第85-86页
第6章 总结与展望第86-88页
参考文献第88-90页
致谢第90-91页
在读期间发表的学术论文与取得的其他研究成果第91页

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