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40Gb/s SerDes发射芯片设计

摘要第4-5页
Abstract第5页
第1章 绪论第8-12页
    1.1 SerDes概述第8-9页
    1.2 国内外发展现状第9-10页
    1.3 本文主要研究内容及组织结构第10-12页
第2章 复接器的基本理论第12-24页
    2.1 复接器的基本结构第12-14页
        2.1.1 串行复接器第12页
        2.1.2 并行复接器第12-13页
        2.1.3 树型复接器第13-14页
    2.2 复接器中的非理想效应第14-18页
        2.2.1 复接器中的时序问题第14-16页
        2.2.2 复接器中的其他非理想效应第16-18页
    2.3 复接器的带宽第18-21页
        2.3.1 眼图第18-19页
        2.3.2 码间干扰第19页
        2.3.3 码间干扰和带宽的关系第19-21页
    2.4 大信号级联系统第21-24页
第3章 复接器的设计与仿真第24-36页
    3.1 系统结构第24-25页
    3.2 电感峰化技术第25-27页
    3.3 模块电路的设计与仿真第27-33页
        3.3.1 正交二分频器设计第27-28页
        3.3.2 四相脉冲发生器设计第28-31页
        3.3.3 直接4:1复接器设计第31-32页
        3.3.4 单转双电路设计第32页
        3.3.5 输出缓冲设计第32-33页
    3.4 复接器的版图与仿真第33-36页
第4章 电荷泵锁相环的基本理论第36-56页
    4.1 电荷泵锁相环概述第36-37页
        4.1.1 锁相的概念第36页
        4.1.2 电荷泵锁相环的工作原理第36-37页
    4.2 电荷泵锁相环的模块电路第37-45页
        4.2.1 分频器第37-40页
        4.2.2 鉴频鉴相器、电荷泵和低通滤波器第40-43页
        4.2.3 压控振荡器第43-45页
    4.3 电荷泵锁相环的环路分析第45-48页
    4.4 相位噪声和抖动第48-51页
        4.4.1 相位噪声的概念第48-49页
        4.4.2 抖动的定义第49-50页
        4.4.3 抖动和相位噪声的关系第50-51页
    4.5 锁相环环路噪声分析第51-56页
第5章 电荷泵锁相环的设计与仿真第56-84页
    5.1 环路参数的选取第56-57页
    5.2 模块电路的设计与仿真第57-79页
        5.2.1 分频器的设计与仿真第57-60页
        5.2.2 PFD/CP/LPF级联系统的设计与仿真第60-72页
        5.2.3 压控振荡器的设计与仿真第72-79页
    5.3 电荷泵锁相环系统仿真第79-84页
        5.3.1 环路稳定性仿真第79-80页
        5.3.2 噪声性能仿真第80-82页
        5.3.3 瞬态仿真第82-84页
第6章 40Gb/s SerDes发射芯片的集成与仿真第84-88页
第7章 总结第88-90页
参考文献第90-92页
致谢第92-93页
攻读硕士学位期间发表的论文第93页

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