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基于40nm工艺电路模块静电放电保护设计的研究

摘要第3-4页
Abstract第4页
第一章 引言第5-9页
    第一节 静电放电技术的概况第6-8页
    第二节 论文的主要工作第8-9页
第二章 静电放电简介第9-30页
    第一节 静电放电的模式第9-15页
    第二节 静电放电的测试第15-19页
    第三节 静电放电保护设计第19-30页
第三章 I/O模块中RC Clamp静电放电保护的优化设计第30-37页
    第一节 RC Clmap的电路工作原理第30-31页
    第二节 RC Clmap的电路验证第31-34页
    第三节 RC Clmap静电放电保护的优化设计第34-37页
第四章 PLL模块静电放电保护的优化设计第37-44页
    第一节 PLL的基本组成第37页
    第二节 PLL模块的静电放电失效分析第37-40页
    第三节 PLL模块静电放电保护的优化设计第40-44页
第五章 ADC模块静电放电保护的优化设计第44-53页
    第一节 ADC模块的基本组成第44-45页
    第二节 ADC模块的静电放电失效分析第45-46页
    第三节 ADC模块静电放电保护的优化设计第46-53页
第六章 全文总结和未来工作第53-54页
参考文献第54-56页
致谢第56-57页
附录1第57-59页
附录2第59-61页

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