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深亚微米和纳米级集成电路的辐照效应及抗辐照加固技术

摘要第5-7页
ABSTRACT第7-9页
符号对照表第17-19页
缩略语对照表第19-24页
第一章 绪论第24-36页
    1.1 课题研究背景第24-28页
        1.1.1 辐射环境第24-26页
        1.1.2 抗辐照大规模集成电路的应用需求第26-28页
    1.2 国内外研究现状第28-33页
    1.3 本文主要研究内容第33页
    1.4 本文组织结构第33-36页
第二章 电离辐射总剂量效应及加固技术第36-66页
    2.1 CMOS器件的总剂量效应概述第36-44页
        2.1.1 电荷生成第36-37页
        2.1.2 氧化层陷阱电荷俘获第37-38页
        2.1.3 界面陷阱电荷俘获第38页
        2.1.4 器件特性改变第38-40页
        2.1.5 边缘漏电效应第40-43页
        2.1.6 NMOSFET漏电流的影响因素第43-44页
    2.2 0.18 μm NMOSFET总剂量辐照实验第44-57页
        2.2.1 core晶体管的总剂量响应第44-48页
        2.2.2 I/O晶体管的总剂量响应第48-53页
        2.2.3 总剂量效应对晶体管特性参数的影响第53-57页
    2.3 0.18 μm NMOSFET抗总剂量加固技术第57-61页
        2.3.1 无边缘晶体管第57-59页
        2.3.2 无边缘晶体管SPICE建模第59-61页
    2.4 纳米器件的总剂量效应第61-64页
        2.4.1 65 nm体硅CMOS器件的总剂量效应第61-62页
        2.4.2 工艺缩减对纳米器件总剂量效应的影响第62-64页
    2.5 本章小结第64-66页
第三章 单粒子效应的机理第66-98页
    3.1 单粒子效应概述第66-69页
    3.2 单粒子瞬态的产生和传播第69-80页
        3.2.1 数字电路中的SET效应第69-70页
        3.2.2 SET脉冲在组合逻辑电路中的传播第70-80页
    3.3 单粒子翻转的形成机制第80-88页
        3.3.1 SEU的物理机制第80页
        3.3.2 SEU模拟仿真第80-88页
    3.4 单粒子效应的若干影响因素第88-97页
        3.4.1 工艺缩减第88-89页
        3.4.2 工作频率提升第89-90页
        3.4.3 离子能量第90页
        3.4.4 离子入射位置第90-91页
        3.4.5 阱接触第91-93页
        3.4.6 离子入射角度和阱结构第93-97页
    3.5 本章小结第97-98页
第四章 单粒子效应的加固技术第98-124页
    4.1 单粒子效应加固技术回顾第98-107页
        4.1.1 工艺加固第98-102页
        4.1.2 设计加固第102-107页
    4.2 一种抗单粒子翻转的新型SRAM单元电路设计第107-115页
    4.3 抗辐射加固标准数字单元库设计第115-122页
        4.3.1 抗辐照加固标准数字单元设计第115-117页
        4.3.2 抗辐照加固标准数字单元库开发第117-118页
        4.3.3 抗辐照加固标准数字单元库的特征化第118-120页
        4.3.4 抗辐照加固标准数字单元测试芯片设计第120-122页
    4.4 本章小结第122-124页
第五章 电路级抗辐照加固设计第124-148页
    5.1 0.18 μm抗辐照CMOS电路设计第124-135页
        5.1.1 抗总剂量加固基准偏置电路设计第124-129页
        5.1.2 芯片测试结果分析第129-131页
        5.1.3 评价电路总剂量效应的正向体偏置法第131-135页
    5.2 65 nm抗辐照CMOS电路设计第135-147页
        5.2.1 电路核心模块设计方案第136-143页
        5.2.2 芯片抗辐照加固设计第143-147页
    5.3 本章小结第147-148页
第六章 总结与展望第148-152页
    6.1 本文主要贡献第148-149页
    6.2 未来工作展望第149-152页
参考文献第152-162页
致谢第162-164页
作者简介第164-166页

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