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基于FPGA的可重构计算硬件平台设计与实现

摘要第5-6页
Abstract第6-7页
第1章 绪论第10-15页
    1.1 课题研究背景第10-11页
    1.2 国内外研究现状第11-13页
        1.2.1 国内外可重构硬件平台研究第11-12页
        1.2.2 可重构硬件平台的设计难点第12-13页
    1.3 课题研究的目的及意义第13-14页
    1.4 主要研究内容第14-15页
第2章 可重构计算技术与平台设计方案第15-29页
    2.1 可重构计算工作原理第15-16页
    2.2 设计需求分析第16-19页
        2.2.1 基础硬件需求第16-17页
        2.2.2 数据交换及存储需求第17页
        2.2.3 SOPC 系统设计需求第17-18页
        2.2.4 功能及关键技术指标第18-19页
    2.3 总体设计方案第19-28页
        2.3.1 可重构器件选择第20-21页
        2.3.2 配置存储系统设计第21-22页
        2.3.3 电源系统设计第22-23页
        2.3.4 PCIe 接口设计第23-24页
        2.3.5 以太网接口设计第24-26页
        2.3.6 数据存储系统第26-27页
        2.3.7 可编程片上系统设计第27-28页
    2.4 本章小结第28-29页
第3章 数据交换及存储设计第29-43页
    3.1 PCIe 接口第29-34页
        3.1.1 PCIe 通信原理第29-30页
        3.1.2 PCIe 硬件电路设计第30-32页
        3.1.3 PCIe 端点 IP 核配置第32-34页
    3.2 以太网接口第34-40页
        3.2.1 以太网通信原理第34-36页
        3.2.2 物理层实现第36-37页
        3.2.3 MAC 层实现第37-39页
        3.2.4 TCP/IP 协议栈第39-40页
    3.3 数据存储系统第40-42页
        3.3.1 DDR3 设计验证及设计规则第40-41页
        3.3.2 MPMC IP 核第41-42页
    3.4 本章小结第42-43页
第4章 可重构 SOPC 系统设计第43-52页
    4.1 SOPC 系统设计第43-46页
        4.1.1 SOPC 系统工作原理第43-44页
        4.1.2 SOPC 系统基本要素第44-46页
        4.1.3 外设 IP 核第46页
    4.2 动态重配置接口第46-47页
    4.3 通用用户 IP 核框架设计第47-51页
        4.3.1 用户自定义 IP 核封装第48-49页
        4.3.2 通用用户 IP 核总体结构第49-51页
    4.4 本章小结第51-52页
第5章 可重构计算硬件平台验证第52-59页
    5.1 PCIe 接口测试第52-56页
        5.1.1 测试环境及方法第53-54页
        5.1.2 测试结果及性能分析第54-56页
    5.2 以太网接口测试第56-57页
    5.3 数据存储及用户 IP 核测试第57-58页
    5.4 小结第58-59页
结论第59-60页
参考文献第60-66页
附录 A第66-69页
攻读学位期间发表的学术论文第69-70页
致谢第70页

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