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基于DSP的无线高速列车噪声监测系统设计

摘要第1-7页
Abstract第7-11页
第1章 绪论第11-16页
   ·引言第11页
   ·国内外研究现状第11-14页
     ·国内国外对高速铁路噪声研究的现状第11-12页
     ·数据采集与数据处理技术的应用现状第12-13页
     ·短距离无线通信技术第13-14页
   ·本论文研究内容第14-16页
第2章 噪声测试原理第16-23页
   ·噪声的基本物理度量和评价指标第16-20页
     ·声压、声压级第16-17页
     ·声强、声强级第17-18页
     ·1/3倍频程第18页
     ·等响曲线、A声级第18-20页
   ·列车噪声第20-21页
     ·列车车内噪声主要特性第20页
     ·车内噪声源及主要传播途径第20-21页
   ·噪声测试第21-22页
   ·本章小结第22-23页
第3章 噪声监测系统总体设计第23-35页
   ·噪声监测系统组成第23-24页
   ·传声器的选型第24-25页
   ·STM32微控制器简介第25-28页
     ·ARM Cortex-M3内核概述第25-26页
     ·NVIC—嵌套向量中断控制器第26-27页
     ·指令集第27页
     ·存储器映射第27页
     ·STM32F103ZET6微控制器第27-28页
   ·TMS320VC5509A DSP简介第28-31页
     ·TMS320C55x DSP基本性能指标第28-29页
     ·C55x的内部结构简介第29-30页
     ·C55x存储空间结构第30-31页
   ·蓝牙技术概述第31-34页
     ·蓝牙技术的特点第31-32页
     ·蓝牙协议体系结构第32-33页
     ·蓝牙系统的组成第33-34页
   ·本章小结第34-35页
第4章 噪声监测系统硬件平台构建第35-58页
   ·ARM控制系统硬件设计第35-45页
     ·ARM芯片最小系统第35-38页
     ·数据采集电路第38-40页
     ·储存电路第40-43页
     ·蓝牙通信模块第43-45页
   ·DSP运算系统硬件设计第45-54页
     ·DSP运算系统总体结构第45-46页
     ·TMS320VC5509A的电源电路第46-47页
     ·复位电路和时钟电路第47-48页
     ·JTAG接口电路第48页
     ·SDRAM存储模块第48-51页
     ·上电引导模式及FLASH存储模块连接第51-54页
   ·DSP与ARM通信电路设计第54-57页
     ·DSP和ARM芯片间通信方式第54-55页
     ·双口RAM结构和仲裁方式第55-56页
     ·双口RAM连接电路第56-57页
   ·硬件布局以及电路板抗干扰设计第57页
   ·本章小结第57-58页
第5章 噪声监测系统软件设计第58-75页
   ·软件开发平台第58-61页
     ·基于ARM的RealView MDK开发环境第58页
     ·STM32固件库简介第58-60页
     ·DSP集成开发环境CCS第60页
     ·DSP软件开发流程以及片级支持库第60-61页
   ·系统软件整体设计第61-62页
     ·系统软件框架第61页
     ·主程序流程第61-62页
   ·系统时钟和系统程序结构第62-64页
     ·系统时钟配置第62-63页
     ·系统程序结构第63-64页
   ·独立看门狗程序第64-65页
   ·数据采集程序第65-67页
     ·通用定时器配置第65-66页
     ·A/D转换程序第66-67页
   ·蓝牙数据通信程序第67-69页
     ·USART—通用同步异步收发机第67页
     ·无线数据发送程序第67-69页
   ·NAND Flash存储程序第69-71页
   ·DSP运算程序第71-75页
     ·DSP与ARM的数据交换第71页
     ·噪声运算程序第71-75页
第6章 系统测试第75-82页
   ·下位机硬件测试第75页
   ·下位机软件调试第75-78页
     ·建立调试平台第75-77页
     ·系统调试和仿真第77-78页
   ·上位机程序开发及试验第78-82页
     ·数据采集监控程序第78-79页
     ·测点布置示意图第79-80页
     ·试验数据验证运算第80-82页
总结第82-83页
致谢第83-84页
参考文献第84-88页
附录1 系统硬件原理图第88-90页
附录2 系统硬件PCB图第90-91页
攻读硕士学位期间发表的学术论文第91页

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