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数字集成电路多故障测试生成算法和可测性设计的研究

摘要第1-7页
Abstract第7-16页
第1章 绪论第16-29页
   ·研究背景及意义第16-17页
   ·数字集成电路测试生成算法的发展和研究现状第17-25页
     ·数字集成电路测试生成算法分类第17-18页
     ·组合电路测试生成算法的发展和研究现状第18-22页
     ·时序电路测试生成算法的发展和研究现状第22-25页
   ·可测性设计的研究现状第25-27页
   ·主要研究内容第27-29页
第2章 组合电路测试生成的三值神经网络模型第29-51页
   ·组合电路测试生成的Hopfield二值神经网络模型第29-40页
     ·基本逻辑门电路的Hopfield二值神经网络模型第30-35页
     ·组合电路的Hopfield神经网络模型第35-37页
     ·组合电路测试生成的二值神经网络模型第37-40页
   ·组合电路测试生成的三值神经网络第40-50页
     ·基本逻辑门电路三值神经网络模型第40-49页
     ·组合电路测试生成的三值神经网络模型第49-50页
   ·本章小结第50-51页
第3章 三值神经网络测试生成算法的实现第51-70页
   ·遗传算法的基本原理第51-52页
   ·基于遗传算法的组合电路测试生成算法第52-59页
     ·编码第53页
     ·适应度函数的确定第53-57页
     ·遗传操作第57-59页
   ·计算能量函数最小值点的遗传算法第59-64页
     ·二值神经网络能量函数最小值点遗传算法的实现第59-63页
     ·三值神经网络能量函数最小值点遗传算法的实现第63-64页
   ·实现算法可采取的措施第64-69页
     ·蕴涵节点和通路敏化第64-65页
     ·电路分块第65-66页
     ·故障合并和压缩第66页
     ·多故障等价第66-69页
   ·本章小结第69-70页
第4章 具有约束条件的布尔差分多故障测试生成简化算法第70-79页
   ·具有约束条件的单故障测试生成简化算法第70-73页
   ·具有约束条件的双故障测试生成简化算法第73-77页
   ·多故障测试生成简化算法第77-78页
   ·本章小结第78-79页
第5章 基于搜索状态控制的测试生成算法第79-86页
   ·基于搜索状态控制的算法第79-82页
     ·基本概念第79-80页
     ·相关定理第80页
     ·算法描述第80-82页
   ·应用实例与实验结果第82-85页
   ·本章小结第85-86页
第6章 可测性设计方法第86-109页
   ·症候群可测性设计方法第86-97页
     ·一元症候群测试法第86-91页
     ·二元症候群测试法第91-95页
     ·多元症候群测试法第95-96页
     ·实验结果第96-97页
   ·基于Reed-Muller模式的组合电路可测性设计方法第97-102页
     ·基本原理第97-98页
     ·Reed-Muller模式电路的故障检测与定位第98-102页
   ·基于故障仿真确定最小故障测试集的方法第102-107页
   ·本章小结第107-109页
结论第109-111页
附录1第111-113页
附录2第113-114页
参考文献第114-122页
攻读学位期间发表的学术论文第122-124页
致谢第124页

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