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基于众核的网络处理平台关键技术研究

摘要第9-10页
ABSTRACT第10-11页
第一章 绪论第12-21页
    1.1 研究背景第12-17页
    1.2 众核发展历程第17-19页
    1.3 主要工作和创新点第19-20页
    1.4 论文的组织结构第20-21页
第二章 相关研究第21-25页
    2.1 网络处理平台第21-22页
    2.2 报文IO调度第22-23页
    2.3 协处理技术第23-24页
    2.4 本章小结第24-25页
第三章 基于众核的网络处理平台架构NPPM第25-36页
    3.1 平台架构第25-29页
        3.1.1 基本思想第25-27页
        3.1.2 总体架构第27-28页
        3.1.3 平台特点第28页
        3.1.4 处理流程第28-29页
    3.2 模型评估第29-32页
        3.2.1 存储资源占用第30页
        3.2.2 模型时延第30-31页
        3.2.3 执行时间第31-32页
        3.2.4 吞吐量第32页
    3.3 关键技术探讨第32-35页
    3.4 本章小结第35-36页
第四章 基于循环队列的报文IO调度技术CycIO第36-49页
    4.1 CycIO报文调度模型第36-39页
        4.1.1 基本思想与调度模型第36-38页
        4.1.2 处理器核负载度量第38页
        4.1.3 负载均衡度量第38-39页
    4.2 报文缓冲区管理第39-43页
        4.2.1 缓冲区组织方法第39-41页
        4.2.2 地址分配第41-42页
        4.2.3 地址回收第42-43页
    4.3 报文调度算法第43-46页
        4.3.1 流表组织与更新第44页
        4.3.2 算法描述第44-46页
    4.4 实现架构第46-48页
    4.5 本章小结第48-49页
第五章 基于直接存储访问的协处理技术DirectCop第49-55页
    5.1 DirectCop协处理器通信模型第49-51页
    5.2 自适应数据传输方法第51-52页
    5.3 模型分析第52-53页
    5.4 实现架构第53-54页
    5.5 本章小结第54-55页
第六章 原型系统实现第55-63页
    6.1 原型系统实现第55-61页
        6.1.1 处理器核第55-56页
        6.1.2 IP核裁剪第56页
        6.1.3 编程环境第56-60页
        6.1.4 FPGA系统第60-61页
    6.2 实验验证与分析第61-62页
    6.3 本章小结第62-63页
第七章 结束语第63-65页
    7.1 本文总结第63页
    7.2 工作展望第63-65页
致谢第65-67页
参考文献第67-70页
作者在学期间取得的学术成果第70页

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