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基于FPGA的集成电路故障注入攻击硬件模拟方法研究

摘要第4-5页
ABSTRACT第5-6页
第1章 绪论第9-16页
    1.1 课题研究背景第9-12页
    1.2 国内外研究现状第12-14页
    1.3 研究内容和论文结构安排第14-16页
第2章 故障注入攻击模拟基础第16-23页
    2.1 概述第16页
    2.2 故障注入攻击技术第16-20页
        2.2.1 故障注入技术第16-19页
        2.2.2 故障分析技术第19-20页
    2.3 抗故障注入攻击技术第20-21页
    2.4 故障模型第21-23页
第3章 故障注入攻击硬件模拟方法第23-35页
    3.1 概述第23页
    3.2 硬件模拟流程第23-25页
    3.3 故障模型处理第25-29页
        3.3.1 寄存器提取第26页
        3.3.2 故障模型框架第26-28页
        3.3.3 故障数据列表第28-29页
    3.4 故障注入机制第29-33页
        3.4.1 扫描设计第29-31页
        3.4.2 硬件架构第31-33页
        3.4.3 故障注入流程第33页
    3.5 抗故障注入攻击评估第33-35页
第4章 故障注入攻击硬件模拟实验第35-47页
    4.1 概述第35页
    4.2 实验设置第35-42页
        4.2.1 待测电路:AES-128 加密电路第36-38页
        4.2.2 差分故障分析算法:AES-128 差分故障分析第38-40页
        4.2.3 故障模型架构参数设置第40-41页
        4.2.4 软件工具和硬件平台第41-42页
    4.3 实验结果和分析第42-47页
        4.3.1 模拟平台资源消耗和性能第42-43页
        4.3.2 评估报告和分析第43-47页
第5章 总结与展望第47-48页
参考文献第48-53页
发表论文和参加科研情况说明第53-54页
致谢第54-55页

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