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结合数字校正技术的低功耗流水线ADC研究与设计

摘要第5-7页
ABSTRACT第7-8页
目录第9-12页
CONTENTS第12-15页
符号表第15-17页
缩略词第17-18页
第一章 绪论第18-28页
    1.1 研究背景第18-21页
    1.2 工艺演进给 ADC 带来的挑战第21-23页
    1.3 数字校正算法第23-25页
    1.4 主要研究内容第25-26页
    1.5 论文组织结构第26-27页
    1.6 本章小结第27-28页
第二章 模数转换器基础第28-60页
    2.1 模数转换基本理论第28-29页
    2.2 模数转换器的性能指标第29-34页
        2.2.1 静态参数第30-32页
        2.2.2 动态参数第32-34页
    2.3 模数转换器的结构分类第34-39页
        2.3.1 全并行模数转换器第35页
        2.3.2 两步式模数转换器第35-36页
        2.3.3 流水线模数转换器第36-37页
        2.3.4 逐次逼近模数转换器第37-38页
        2.3.5 - 过采样模数转换器第38-39页
    2.4 流水线模数转换器的基本原理分析第39-40页
    2.5 流水线模数转换器结构及电路模块第40-47页
        2.5.1 采样保持电路第41-42页
        2.5.2 子模数转换器第42-43页
        2.5.3 余量增益放大器第43-47页
            2.5.3.1 电荷重分配型 MDAC第43-45页
            2.5.3.2 电容翻转型 MDAC第45-47页
    2.6 流水线模数转换器中的非理想因素分析第47-57页
        2.6.1 噪声第48-51页
        2.6.2 比较器失调第51页
        2.6.3 电容失配第51-53页
        2.6.4 运放的有限增益误差第53-54页
        2.6.5 运放有限建立时间和有限带宽第54-55页
        2.6.6 时钟抖动的影响第55-57页
    2.7 冗余编码技术第57-58页
    2.8 本章小结第58-60页
第三章 10b 50MS/s 流水线模数转换器设计第60-87页
    3.1 引言第60页
    3.2 体系结构及低功耗考虑第60-63页
        3.2.1 系统结构第60-61页
        3.2.2 低功耗设计考虑第61-63页
    3.3 电路设计第63-81页
        3.3.1 运算放大器的设计及选择第63-72页
        3.3.2 比较器的设计第72-73页
        3.3.3 采样开关第73-79页
        3.3.4 时钟电路第79-81页
    3.4 版图设计第81页
    3.5 测试方案第81-83页
    3.6 测试结果第83-86页
    3.7 本章小结第86-87页
第四章 14b 100MS/s 流水线模数转换器研究与设计第87-125页
    4.1 引言第87页
    4.2 系统结构设计第87-88页
    4.3 SHA-Less 前端实现第88-92页
    4.4 关键电路设计第92-100页
        4.4.1 采用偏置与输入轮换技术的运算放大器第92-95页
        4.4.2 比较器设计第95-97页
        4.4.3 改进的增益自举开关第97-98页
        4.4.4 两相不交叠时钟第98-100页
    4.5 数字后台校正技术第100-117页
        4.5.1 MDAC 非线性模型第101-103页
        4.5.2 伪随机序列注入数字后台校正技术第103-109页
        4.5.3 信号相关抖动校正算法第109-117页
            4.5.3.1 1.5 -bit 每级结构中的信号相关抖动校正技术第109-113页
            4.5.3.2 多比特每级结构中的信号相关抖动校正技术第113-117页
    4.6 版图设计第117-120页
    4.7 仿真结果第120-124页
    4.8 本章小结第124-125页
结论第125-127页
参考文献第127-135页
攻读博士学位期间取得的研究成果第135-137页
致谢第137-138页
答辩委员会对论文的评定意见第138页

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