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微处理器性能分析模型的建立和研究

摘要第1-5页
Abstract第5-7页
目录第7-10页
图目录第10-14页
表目录第14-15页
第一章 引言第15-25页
   ·微处理器的性能模型第15-20页
     ·信号级性能模型及相关优化技术第17-18页
     ·结构级性能模型介绍第18-19页
     ·性能分析模型介绍第19-20页
   ·基准程序集介绍第20-21页
     ·真实应用基准程序第20页
     ·核心程序段第20页
     ·合成基准程序第20-21页
   ·商用处理器的性能分析环境第21页
   ·研究背景第21-22页
   ·本文的贡献第22-23页
   ·论文的组织第23-25页
第二章 基于理想上限的分析模型第25-35页
   ·相关工作第25-26页
   ·Godson-Microbench的设计第26-29页
     ·E-Benchmark第28页
     ·C-Benchmark第28-29页
     ·M-Benchmark第29页
   ·基于理想上限的分析模型第29-33页
   ·基于理想上限的性能分析流程第33-35页
第三章 指令窗口模型第35-59页
   ·IW特性曲线和ILP平方根定律第36-37页
   ·指令级并行性的相关研究第37-39页
   ·模型的建立与分析第39-50页
     ·建模方法第40-42页
     ·动态相关指令距离与指令发射概率第42-43页
     ·SPEC CPU 2000动态相关指令距离的分布规律第43-47页
     ·IW调和级数规律第47-48页
     ·编译优化对指令级并行性的影响第48-50页
   ·模型验证及改进第50-53页
   ·模型应用第53-57页
     ·估算程序指令级并行性第53-54页
     ·揭示指令级并行性中存在的规律第54-57页
   ·本章小结第57-59页
第四章 超标量处理器的分析模型第59-79页
   ·流水线稳定状态模型第60-66页
     ·功能部件延迟L_(FU-Avg)对理想IPC的影响第60-63页
     ·功能部件数目N_(FU-Class)对理想IPC的影响第63-66页
   ·分支误预测事件建模第66-71页
     ·分支误预测率R_(BM)第66-69页
     ·分支误预测开销P_(BM)第69-71页
   ·指令Cache失效事件建模第71-73页
     ·指令Cache失效率R_(ICM)第71-72页
     ·指令Cache失效开销P_(ICM)第72-73页
   ·数据Cache失效事件建模第73-79页
     ·数据Cache失效率R_(DCM)第73-74页
     ·数据Cache失效开销P_(DCM)第74-79页
第五章 模型校验与误差分析第79-85页
   ·理想CPI模型的校验第79页
   ·功能部件受限模型的CPI校验第79-80页
   ·分支误预测事件模型的CPI校验第80-81页
   ·指令Cache失效事件模型的CPI校验第81页
   ·数据Cache失效事件模型的CPI校验第81-82页
   ·完整模型的CPI校验第82-85页
第六章 模型应用第85-97页
   ·龙芯2号处理器性能评估第85-87页
   ·微处理器设计空间探索第87-97页
     ·指令级并行性变化趋势第87-90页
     ·各种队列有效长度分析第90-94页
     ·功能部件有效设置分析第94-97页
第七章 性能分析及结构改进第97-111页
   ·性能测试环境第97-98页
   ·性能分析结果第98-99页
   ·性能数据比较与结构优化第99-103页
     ·Alpha21264性能分析第99-100页
     ·龙芯2号性能分析第100-103页
   ·功能部件动态反馈式分配策略第103-109页
     ·功能部件分配策略的相关研究第104-105页
     ·动态反馈式分配策略的设计与实现第105-106页
     ·实验平台第106-107页
     ·性能评测与分析第107-109页
     ·小结第109页
   ·性能改进与结论第109-111页
第八章 结束语第111-113页
   ·本文工作总结第111-112页
   ·下一步研究方向第112-113页
参考文献第113-119页
致谢第119-120页
作者简历第120页

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