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高速视频解码器设计研究

第一章 绪论第1-36页
 第一节 视频编解码标准及其应用第8-17页
  1.1.1 图像编解码原理第8-10页
  1.1.2 视频编解码标准的基本算法框架第10-16页
  1.1.3 视频编码码流的分层结构第16-17页
 第二节 视频解码器结构第17-29页
  1.2.1 专用视频解码器结构第17-20页
  1.2.2 可编程视频编解码器结构第20-27页
  1.2.3 结构比较及其应用第27-29页
 第三节 视频解码器设计方法第29-34页
  1.3.1 嵌入式系统的软硬件协同设计策略第29-31页
  1.3.2 高速视频解码器的设计方法第31-34页
 第四节 本文的研究成果及内容安排第34-36页
第二章 高速视频解码器的并行结构研究第36-70页
 第一节 高速视频解码器的设计策略第36-42页
  2.1.1 高速视频解码的计算复杂度分析第36-37页
  2.1.2 高速视频解码器的软硬件划分第37-38页
  2.1.3 高速视频解码器的多层次并行框架第38-42页
 第二节 查表型解码的并行分析及其结构优化设计第42-46页
  2.2.1 变字长码的并行解码研究第42-44页
  2.2.2 变字长解码的并行结构优化设计第44-46页
 第三节 时间并行处理的分析和设计方法第46-49页
  2.3.1 流水线的工作原理和表示方法第46页
  2.3.2 流水线的分析方法第46-48页
  2.3.3 流水线的设计要点第48-49页
 第四节 IDCT并行解码分析及其调度策略第49-61页
  2.4.1 IDCT的并行解码分析第49-54页
  2.4.2 IDCT的简单流水线分析第54-56页
  2.4.3 IDCT的复杂流水线分析和调度策略第56-61页
 第五节 MC的并行解码分析及其数据调度策略第61-69页
  2.5.1 运动补偿任务的多层次并行结构划分第61-64页
  2.5.2 运动补偿任务的复杂数据调度第64-69页
 第六节 本章小结第69-70页
第三章 高速视频解码器的控制策略第70-93页
 第一节 高速视频解码器总控方式分析第70-73页
  3.1.1 数据驱动控制策略和流水线控制策略第70页
  3.1.2 数据驱动和流水线的性能比较第70-73页
 第二节 数据通路及其性能分析第73-78页
  3.2.1 基于数据队列的解码网络结构第73-75页
  3.2.2 解码网络的阻塞分析和优化第75-78页
 第三节 控制信息通路策略第78-82页
  3.3.1 控制信息通路的建立第78-79页
  3.3.2 控制信息的空间分配和同步策略第79-82页
 第四节 实例分析——IZZ和IQ单元的数据、控制通路设计第82-89页
  3.4.1 IZZ/IQ输入单元结构第82-83页
  3.4.2 IZZ/IQ输出单元结构第83-85页
  3.4.3 IZZ/IQ处理单元结构第85-89页
 第五节 数据驱动的视频解码结构第89-92页
  3.5.1 高速视频解码器的数据和控制信息网络第89-90页
  3.5.2 性能分析和比较第90-92页
 第六节 本章小结第92-93页
第四章 高速视频解码器仿真策略研究第93-115页
 第一节 ASIC的软硬件协同仿真策略第93-96页
  4.1.1 传统的ASIC仿真方法第93-95页
  4.1.2 软硬件协同仿真策略第95-96页
 第二节 高速视频解码器的仿真策略第96-106页
  4.2.1 数据驱动处理单元的仿真特点第96-98页
  4.2.2 多级抽象层混合的局部仿真策略第98-101页
  4.2.3 “拼装”式仿真策略及软硬件仿真环境设计第101-104页
  4.2.4 基于软硬件仿真环境的仿真方法第104-106页
 第三节 高速视频解码器的参数化设计与系统优化第106-110页
  4.3.1 参数化设计策略与系统优化第106-107页
  4.3.2 实例分析第107-110页
 第四节 优化的测试序列第110-114页
 第五节 本章小结第114-115页
第五章 总结与展望第115-117页
参考文献第117-124页
致谢第124页

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