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基于DVI接口的视频图像压缩编码的FPGA设计

第一章 绪论第1-13页
   ·引言第8-9页
   ·数字显示接口(DVI)简介第9页
   ·视频图像压缩编码标准简介第9-11页
     ·MPEG 系列标准第10-11页
     ·H.26X 系列标准第11页
   ·本文主要内容第11-13页
第二章 DVI 通讯协议及解码电路第13-21页
   ·DVI 接口构成第13-16页
     ·T.M.D.S 协议介绍第13-15页
     ·DVI 接口的具体参数第15-16页
   ·DVI 解码电路第16-20页
     ·DVI 解码芯片介绍第16-17页
     ·DVI 解码电路原理及输出波形图第17-20页
   ·本章小结第20-21页
第三章 FPGA 系统设计方法第21-28页
   ·FPGA 简介第21-24页
     ·FPGA 的发展第21页
     ·FPGA/CPLD 工作原理第21-22页
     ·FPGA 的特点第22页
     ·FPGA 设计流程第22-24页
   ·硬件描述语言简介第24-25页
   ·QUARTUSII 软件简介第25页
   ·FPGA 系统基本设计原则第25-27页
     ·面积和速度的平衡与互换原则第25-26页
     ·硬件原则第26页
     ·系统原则第26-27页
     ·同步设计原则第27页
   ·本章小结第27-28页
第四章 视频图像压缩编码系统总体设计第28-39页
   ·视频图像数据压缩原理第28-29页
     ·数据压缩的必要性及可行性第28-29页
     ·图像压缩编码分类第29页
   ·H.263 视频编码内容及相关知识第29-35页
     ·H.263 建议简介第29-30页
     ·信源图像结构第30-31页
     ·H.263 基本编码模式第31-32页
     ·H.263 编码标准的附加模式第32-35页
   ·基于硬件实现的视频压缩编码系统第35-38页
     ·系统整体结构介绍第35-37页
     ·系统各功能模块介绍第37-38页
   ·本章小结第38-39页
第五章 DCT/IDCT 及运动估值模块的 FPGA 实现第39-60页
   ·DCT/IDCT 模块第39-54页
     ·变换编码技术简介第39-40页
     ·DCT/IDCT 基本算法第40-44页
     ·DCT/IDCT 硬件实现方案第44-50页
     ·功能验证及硬件仿真结果分析第50-54页
   ·运动估值模块第54-59页
     ·运动估值原理第54页
     ·运动估值算法第54-56页
     ·运动估值的硬件实现方案第56-59页
     ·功能验证及硬件仿真结果分析第59页
   ·本章小结第59-60页
第六章 视频图像压缩编码的 FPGA 实现第60-89页
   ·视频格式转换模块第60-64页
     ·视频格式转换的目的第60-61页
     ·视频格式转换计算方法第61页
     ·视频格式转换硬件实现方案第61-63页
     ·功能验证及硬件仿真结果分析第63-64页
   ·量化/反量化模块第64-67页
     ·量化/反量化原理及过程第64-65页
     ·量化/反量化硬件实现方案第65-66页
     ·功能验证及硬件仿真结果分析第66-67页
   ·码流复合模块第67-80页
     ·码流复合原理第67页
     ·ZIGZAG 编码原理及硬件实现第67-70页
     ·游程编码的原理及硬件实现第70-72页
     ·可变长(VLC)编码的原理及硬件实现第72-79页
     ·码流复合原理及硬件实现第79-80页
   ·码率控制模块第80-84页
     ·码率控制原理第80-81页
     ·码率控制的基本算法第81-83页
     ·码率控制的硬件实现方案第83-84页
     ·功能验证及硬件仿真结果分析第84页
   ·压缩编码系统实验结果分析第84-85页
   ·FPGA 芯片配置及下载第85-88页
     ·FPGA 配置与连接第85-87页
     ·FPGA 的配置过程第87-88页
   ·本章小结第88-89页
第七章 全文总结第89-91页
   ·本文主要工作及结论第89-90页
   ·今后工作展望第90-91页
参考文献第91-94页
摘要第94-98页
ABSTRACT第98-103页
致谢第103页

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