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一种超长指令字同时多线程处理器的设计与分析

图目录第1-9页
表目录第9-10页
摘要第10-11页
ABSTRACT第11-12页
第一章 绪论第12-19页
 §1.1 数字信号处理器概述第12-14页
  §1.1.1 DSP芯片的出现与历史第12-13页
  §1.1.2 DSP芯片特点第13-14页
  §1.1.3 未来高性能DSP发展趋势第14页
 §1.2 同时多线程技术第14-17页
  §1.2.1 同时多线程概念第14-16页
  §1.2.2 SMT处理器研究现状第16-17页
 §1.3 课题背景、意义及目标第17页
 §1.4 本文的主要工作及创新第17-18页
 §1.5 本文的组织结构第18-19页
第二章 YHFT-D4的体系结构及MOSI分析第19-27页
 §2.1 YHFT-D4的体系结构第19-24页
  §2.1.1 CPU结构第19-20页
  §2.1.2 流水线结构第20-24页
 §2.2 MOSI微体系结构第24-26页
  §2.2.1 指令包分离发射第24-25页
  §2.2.2 写回缓冲第25-26页
 §2.3 小结第26-27页
第三章 YHFT—DSP/SMTOO的设计第27-44页
 §3.1 YHFT—DSP/SMTOO体系结构设计第27-28页
 §3.2 取指单元设计第28-32页
  §3.2.1 单元功能概述第28-29页
  §3.2.2 单元总体结构设计第29-31页
  §3.2.3 分支缓冲的设计第31-32页
 §3.3 派发单元设计第32-38页
  §3.3.1 同时多线程派发策略分析第32-33页
  §3.3.2 单元总体结构设计第33-35页
  §3.3.3 执行包分离发射机制的实现第35-38页
 §3.4 译码单元设计第38-39页
 §3.5 数据通路设计第39-40页
  §3.5.1 功能单元设计第39页
  §3.5.2 数据寻址通路的竞争第39-40页
 §3.6 写回缓冲设计第40-42页
  §3.6.1 写回缓冲结构第40-41页
  §3.6.2 缓冲编号的产生及更新第41页
  §3.6.3 缓冲单元数据的更新第41-42页
  §3.6.4 寄存器的写回第42页
 §3.7 控制寄存器文件设计第42页
 §3.8 小结第42-44页
第四章 YHFT—DSP/SMTOO的设计验证第44-52页
 §4.1 验证技术分析第44-46页
 §4.2 软件模拟验证第46-51页
  §4.2.1 测试向量的开发第46-49页
  §4.2.2 全芯片模拟程序、工具及方法第49-50页
  §4.2.3 模拟验证结果第50-51页
 §4.3 小结第51-52页
第五章 YHFT—DSP/SMTOO的性能分析第52-61页
 §5.1 评价DSP性能的方法第52-55页
  §5.1.1 传统的性能评价方法第52-53页
  §5.1.2 应用型评价指标第53页
  §5.1.3 核心算法评价指标第53-54页
  §5.1.4 EEMBC性能指标第54-55页
 §5.2 性能评测的方法及测试程序分析第55-56页
 §5.3 性能评测的结果及分析第56-60页
 §5.4 小结第60-61页
第六章 YHFT—DSP/SMTOO的逻辑综合及优化第61-66页
 §6.1 综合的基本思想及流程第61-62页
 §6.2 综合优化方法分析第62-65页
  §6.2.1 代码风格第62-63页
  §6.2.2 模块划分第63-64页
  §6.2.3 综合策略选择第64页
  §6.2.4 约束条件设置第64-65页
 §6.3 综合优化结果第65页
 §6.4 小结第65-66页
第七章 结束语第66-68页
 §7.1 工作总结第66页
 §7.2 工作展望第66-68页
致谢第68-69页
硕士研究生期间发表的论文第69-70页
参考文献第70-71页

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