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数字射频中全数字锁相环技术的研究

摘要第1-5页
Abstract第5-12页
第1章 引言第12-26页
   ·论文的研究背景第12-14页
     ·软件无线电第12-13页
     ·CMOS 工艺下射频电路的实现第13-14页
   ·数字射频第14-19页
     ·基于极化调制的发射机第16-17页
     ·基于MTDSM 的接受机第17-18页
     ·数字射频的主要优势第18-19页
   ·数字射频中全数字锁相环第19-22页
   ·论文的主要工作和贡献第22-24页
   ·论文各部分的安排第24-26页
第2章 数字射频中全数字锁相环基础第26-44页
   ·数字域相位误差提取第26-35页
     ·时钟调整第27-28页
     ·时间数字转换器(TDC)第28-29页
     ·相位累加器第29-31页
     ·相位域工作原理第31-35页
   ·数控振荡器(DCO)第35-36页
   ·数字环路滤波器(DLF)第36-37页
   ·全数字锁相环s 域模型第37-40页
     ·Ⅰ型一阶ADPLL第37-38页
     ·Ⅱ型二阶ADPLL第38-40页
   ·全数字锁相环系统噪声分析第40-43页
   ·本章小结第43-44页
第3章 ADPLL 行为级建模与仿真和自适应环路滤波器设计第44-71页
   ·Verilog-A 语言概述第44-45页
   ·仿真策略和流程第45-47页
   ·基于Verilog-A 电路模型设计第47-56页
     ·DCO 的模型第47-51页
     ·Sigma-Delta 调制器模型第51-52页
     ·时间数字转换器模型第52-53页
     ·相位累加器模型第53-54页
     ·数字环路滤波器第54-55页
     ·其他模型第55-56页
   ·全数字锁相环Verilog-A 模型仿真结果第56-59页
   ·全数字锁相环自适应滤波器第59-68页
     ·一种Ⅰ型环路自适应滤波器第59-61页
     ·Ⅱ型环路二阶滤波器分析第61-66页
     ·一种Ⅱ型环路自适应滤波器第66-68页
   ·自适应滤波器仿真结果第68-70页
   ·本章小结第70-71页
第4章 提高LC 数控振荡器调频精度方法的研究第71-88页
   ·LC 数控振荡器第71-80页
     ·LC 振荡器的原理与基本结构第71-74页
     ·数控变容管第74-75页
     ·数控振荡器的量化噪声第75-77页
     ·Sigma-Delta 调制以及其对量化噪声的影响第77-80页
   ·互补型数控MOS 变容管对第80-82页
   ·基于失配电容对数控振荡器第82-85页
   ·仿真结果第85-87页
   ·本章小结第87-88页
第5章 提高时间数字转换器分辨率方法的研究第88-108页
   ·时间数字转换器简介第88-91页
     ·时间数字转换器研究背景第88-90页
     ·时间数字转换器量化噪声第90-91页
   ·基于单沿的时间数字转换器第91-99页
     ·传统TDC 延时链分析第91-93页
     ·基于单沿延时链分析第93-95页
     ·单沿TDC 系统结构第95-97页
     ·仿真结果第97-99页
   ·基于互连线插值的TDC第99-106页
     ·基于互连线插值TDC 系统结构第99-102页
     ·利用互连线实现等延时的方法第102-104页
     ·仿真结果第104-106页
   ·本章小结第106-108页
第6章 超大规模集成电路中互连线延时的研究第108-127页
   ·互连线延时估算概述第108-111页
     ·基于RC 网络的Elmore 估算方法第109-110页
     ·基于RLC 网络的Kahng 估算方法第110-111页
   ·互连线ABCD 矩阵描述第111-113页
   ·互连线延时的分类第113-116页
   ·基于ABCD 矩阵延时模型第116-122页
     ·迭代公式推导第116-118页
     ·传输函数的稳定策略第118-120页
     ·一种新的延时模型第120-122页
   ·仿真结果第122-125页
   ·本章小结第125-127页
第7章 工作总结和展望第127-130页
   ·论文工作总结第127-129页
   ·研究工作展望第129-130页
参考文献第130-138页
致谢第138-139页
个人简历、在学期间发表的学术论文与研究成果第139-140页

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