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基于UVM的浮点倒数方根电路模块验证

摘要第5-6页
ABSTRACT第6-7页
符号对照表第11-12页
缩略语对照表第12-16页
第一章 绪论第16-22页
    1.1 课题的背景第16页
    1.2 国内外研究现状第16-18页
        1.2.1 浮点处理单元现状第16-17页
        1.2.2 验证的现状第17-18页
    1.3 课题的意义及内容第18-19页
    1.4 论文的组织结构第19-22页
第二章 浮点数据格式和UVM验证方法学第22-36页
    2.1 浮点数据格式第22-24页
        2.1.1 IEEE754标准第22页
        2.1.2 浮点数据格式详细介绍第22-23页
        2.1.3 浮点数值表示第23-24页
    2.2 浮点处理异常的规则第24-28页
        2.2.1 舍入模式第24-25页
        2.2.2 异常处理第25-28页
    2.3 UVM验证方法学第28-33页
        2.3.1 UVM验证平台第28-30页
        2.3.2 UVM中的component和object第30-31页
        2.3.3 验证平台中的机制第31-33页
    2.4 验证平台内部的通信第33-35页
        2.4.1 UVM中的端口互连第33页
        2.4.2 UVM中的analysis端口第33-34页
        2.4.3 UVM中的FIFO通信第34-35页
    2.5 SV语言第35页
    2.6 本章小结第35-36页
第三章 浮点倒数方根模块的设计与实现第36-48页
    3.1 指令集分析第36-40页
        3.1.1 指令格式第36-37页
        3.1.2 倒数指令第37-38页
        3.1.3 平方根倒数指令第38-40页
        3.1.4 特殊值处理第40页
    3.2 算法分析第40-44页
    3.3 FSEM的设计第44-47页
    3.4 本章小结第47-48页
第四章 基于UVM证平台的搭建第48-70页
    4.1 验证流程第48-49页
    4.2 验证策略第49-51页
        4.2.1 测试用例testcase方案第49页
        4.2.2 功能点覆盖点收集分析第49-51页
    4.3 验证计划第51-52页
    4.4 验证平台整体构建第52-53页
    4.5 验证平台中小组件的设计第53-56页
        4.5.1 接口设计第53页
        4.5.2 事务设计第53-54页
        4.5.3 驱动器的设计第54页
        4.5.4 监视器的设计第54-55页
        4.5.5 测试用例的设计第55页
        4.5.6 virtual sequence和virtual sequencer的设计第55-56页
    4.6 激励生成器的设计第56-61页
        4.6.1 指令译码生成激励第57-58页
        4.6.2 源操作数生成激励第58-61页
        4.6.3 状态位使能信号生成激励第61页
    4.7 结果收集组件第61-69页
        4.7.1 结果收集组件的设计第61-62页
        4.7.2 记分版的设计第62-64页
        4.7.3 功能覆盖率建模第64-68页
        4.7.4 参考模型第68-69页
    4.8 本章小结第69-70页
第五章 平台的配置/运行和结果分析第70-82页
    5.1 平台的配置和运行第70-71页
        5.1.1 初始化配置第70页
        5.1.2 综合仿真与调试第70-71页
    5.2 覆盖率的结果分析第71-75页
        5.2.1 软件配置及分析流程第71-72页
        5.2.2 代码覆盖率第72-73页
        5.2.3 功能覆盖率第73-75页
    5.3 MDV验证方法第75-80页
        5.3.1 可执行验证计划第75-77页
        5.3.2 仿真回归性检测第77-79页
        5.3.3 验证状态报告第79-80页
    5.4 本章小结第80-82页
第六章 总结与展望第82-84页
    6.1 总结第82页
    6.2 展望第82-84页
参考文献第84-86页
致谢第86-88页
作者简介第88-89页

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