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X86嵌入式Internet系统研究及开发

第1章 绪论第1-15页
 1.1 论文选题的背景及意义第8-12页
  1.1.1 嵌入式Internet技术的发展及趋势第8-9页
  1.1.2 嵌入式Internet技术的应用前景第9-10页
  1.1.3 嵌入式Internet技术是工业测控网络发展的必然第10-12页
 1.2 国内外研究现状第12-13页
 1.3 本文的研究背景及所作的工作第13-15页
第2章 X86嵌入式INTERNET系统构成第15-23页
 2.1 嵌入式系统概述第15-16页
  2.1.1 嵌入式系统的发展及其特点第15-16页
  2.1.2 嵌入式系统核心硬件平台第16页
  2.1.3 嵌入式实时操作系统第16页
 2.2 嵌入式Internet系统设计原理第16-18页
 2.3 高端X86嵌入式Internet系统的设计第18-23页
  2.3.1 为什么要选择X86平台第18-19页
  2.3.2 X86嵌入式系统特性与应用第19-20页
  2.3.3 基于X86的嵌入式Internet方案第20-23页
第3章 系统硬件设计原理及功能配置第23-43页
 3.1 系统设计原理第23-31页
  3.1.1 (?)lan SC520微控制器概述第23-24页
  3.1.2 系统地址映射第24-27页
  3.1.3 可编程地址区寄存器(PAR)第27-29页
  3.1.4 系统存储器地址空间分配第29-30页
  3.1.5 系统资源配置第30-31页
 3.2 系统硬件设计第31-35页
  3.2.1 硬件功能框图第31页
  3.2.2 (?)lanSC520微控制器引脚信号第31-32页
  3.2.3 时钟、复位及电源电路:第32-33页
  3.3.4 ROM/FLASH接口电路设计第33-34页
  3.2.5 同步动态RAM(SDRAM)接口电路设计第34-35页
 3.3 系统初始化过程描述第35-43页
  3.3.1 系统BIOS初始化过程第35-36页
  3.3.2 复位:第36-39页
  3.3.3 ROM/FLASH控制器:第39页
  3.3.4 GP BUS控制器:第39-40页
  3.3.5 SDRAM动态控制器:第40页
  3.3.6 可编程中断PCI控制器:第40-43页
第4章 POI总线以太网接口设计第43-58页
 4.1 PCI总线以太网接口硬件电路设计第43-49页
  4.1.1 PCI总线概述第43页
  4.1.2 PCI总线操作简介:第43-45页
  4.1.3 PCI总线接口信号:第45-46页
  4.1.4 PCI总线主桥:第46-47页
  4.1.5 PCI以太网络接口电路设计第47-49页
 4.2 PCI总线以太网接口驱动设计第49-58页
  4.2.1 PCI总线配置空间第49-50页
  4.2.2 PCI总线配置机制第50-51页
  4.2.3 系统设计中的PCI配置机制第51页
  4.2.4 RTL 8139D(L)配置空间表及操作寄存器第51-54页
  4.2.5 数据发送控制过程第54页
  4.2.6 数据接收控制过程第54-55页
  4.2.7 驱动程序代码及其分析第55-58页
第5章 嵌入式TOP/IP协议栈的实现及测试第58-63页
 5.1 TCP/IP网络协议第58-59页
 5.2 嵌入式TCP/IP网络协议栈的实现第59-61页
 5.3 TCP/IP协议栈在系统中的测试第61-63页
第6章 系统调试开发及应用第63-68页
 6.1 CSNET系统平台在应用中的调试开发第63-66页
  6.1.1 系统平台技术指标及硬件接口第63页
  6.1.2 系统平台运行及开发第63-66页
 6.2 CSNET系统平台在实际中的应用第66-68页
结论第68-70页
致谢第70-71页
参考文献第71-74页
攻读硕士学位期间发表的论文第74-75页
附录1:第75-78页

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