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基于UVM对IP核UART的验证研究与实现

摘要第5-6页
ABSTRACT第6-7页
符号对照表第11-12页
缩略语对照表第12-16页
第一章 绪论第16-22页
    1.1 选题的背景和意义第16-17页
    1.2 课题研究的国内外趋势第17-19页
    1.3 课题研究的性能指标第19页
    1.4 论文的章节安排第19-22页
第二章 验证的相关理论第22-30页
    2.1 IP的概论第22-23页
        2.1.1 IP的简介第22页
        2.1.2 IP的应用现状和前景第22-23页
    2.2 验证技术的概论第23-28页
        2.2.1 验证的概述第23-24页
        2.2.2 验证语言发展第24-25页
        2.2.3 功能验证技术第25-28页
        2.2.4 主流验证技术的缺点第28页
    2.3 本章小结第28-30页
第三章 UVM验证方法学简介第30-42页
    3.1 UVM的特性第30-31页
    3.2 UVM的类第31-32页
    3.3 UVM的树形结构第32-33页
    3.4 UVM验证环境机制第33-37页
        3.4.1 UVM的factory机制第33-34页
        3.4.2 UVM的phase机制第34-35页
        3.4.3 UVM的sequence机制第35-36页
        3.4.4 UVM的config_db机制第36-37页
    3.5 UVM中的TLM通信第37-39页
    3.6 UVM中的寄存器模型第39-41页
    3.7 本章小结第41-42页
第四章 UART核验证实现需求及策略第42-60页
    4.1 UART核概述第42-43页
    4.2 UART软核端口功能介绍第43-49页
        4.2.1 UART主要功能概述第44-46页
        4.2.2 端口信号概述第46-47页
        4.2.3 UART的寄存器概述第47-49页
    4.3 UART验证平台的思想策略第49-59页
        4.3.1 验证平台规划第49-50页
        4.3.2 UART验证平台的重要特性第50-53页
        4.3.3 功能点的提取与分析第53-55页
        4.3.4 带约束的随机激励第55-56页
        4.3.5 结果检查第56页
        4.3.6 分析覆盖率第56-59页
    4.4 本章小结第59-60页
第五章 UART验证平台的实现第60-78页
    5.1 验证平台的总体架构第60-61页
    5.2 UART验证组件的实现第61-76页
        5.2.1 事务基类transaction设计第62-63页
        5.2.2 序列发生器sequencer设计第63页
        5.2.3 驱动器组件driver设计第63-67页
        5.2.4 监控器组件monitor设计第67-68页
        5.2.5 代理器组件agent设计第68-69页
        5.2.6 计分板组件scoreboard设计第69-71页
        5.2.7 序列发生器激励sequence设计第71-72页
        5.2.8 接口interface设计第72-73页
        5.2.9 功能覆盖率组件设计第73-74页
        5.2.10 验证环境env设计第74-75页
        5.2.11 测试用例tastcase设计第75页
        5.2.12 顶层设计第75-76页
    5.3 本章小结第76-78页
第六章 UART核的仿真与分析第78-86页
    6.1 验证环境第78页
    6.2 基本测试用例第78-83页
        6.2.1 APB对寄存器读写访问测试第78-79页
        6.2.2 波特率测试第79-80页
        6.2.3 收发数据测试第80-81页
        6.2.4 收发数据的中断测试第81-82页
        6.2.5 Modem端口自环绕收发测试第82-83页
    6.3 代码覆盖率统计第83-84页
    6.4 功能覆盖率统计第84-85页
    6.5 本章小结第85-86页
第七章 总结与展望第86-88页
    7.1 总结第86页
    7.2 展望第86-88页
参考文献第88-90页
致谢第90-92页
作者简介第92-93页

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