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数字下变频技术及其FPGA实现

摘要第5-6页
ABSTRACT第6页
缩略语对照表第10-13页
第一章 绪论第13-17页
    1.1 本课题的背景和意义第13-14页
    1.2 数字下变频技术的国内外发展现状第14页
    1.3 本文的研究内容和结构安排第14-17页
第二章 数字下变频技术的相关理论第17-49页
    2.1 数字下变频技术基本理论及框图介绍第17-19页
    2.2 数字控制振荡器第19-25页
    2.3 积分梳状滤波器第25-30页
    2.4 半带滤波器第30-33页
    2.5 有限冲击长度响应滤波器第33-48页
        2.5.1 定义第33-34页
        2.5.2 特性第34页
        2.5.3 滤波器设计方法第34-48页
    2.6 小结第48-49页
第三章 数字下变频技术及其主要模块的设计第49-69页
    3.1 下变频系统设计要求第49页
    3.2 下变频系统的总体构架第49-53页
        3.2.1 系统整体框架第49-50页
        3.2.2 混频部分第50-52页
        3.2.3 多级采样率转换系统第52-53页
    3.3 子模块的实现第53-67页
        3.3.1 梳妆滤波器第53-58页
        3.3.2 混频模块第58-63页
        3.3.3 HBF模块第63-64页
        3.3.4 MPF3_1 模块第64-65页
        3.3.5 MPF3_2 模块第65-66页
        3.3.6 带通滤波输出模块第66-67页
    3.4 小结第67-69页
第四章 基于Modelsim的仿真验证第69-79页
    4.1 CIC滤波器模块第69-70页
    4.2 混频模块第70页
    4.3 HBF模块第70-72页
    4.4 MPF3_1 模块第72-73页
    4.5 MPF3_2 模块第73-75页
    4.6 BPF模块第75-77页
    4.7 小结第77-79页
第五章 基于FPGA的验证第79-91页
    5.1 电路的综合第79-82页
        5.1.1 电路分析第79-80页
        5.1.2 资源利用分析第80-82页
    5.2 系统基于FPGA的功能验证第82-89页
        5.2.2 240ksps信号码率第82-84页
        5.2.3 160ksps信号码率第84-85页
        5.2.4 80ksps信号码率第85-86页
        5.2.5 32ksps信号码率第86-88页
        5.2.6 16ksps信号码率第88-89页
    5.3 小结第89-91页
第六章 总结与展望第91-93页
    6.1 总结第91-92页
    6.2 展望第92-93页
参考文献第93-95页
致谢第95-97页
作者简介第97-98页

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