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一种低复杂度的线性全数字锁相环的设计与实现

摘要第5-6页
ABSTRACT第6页
第一章 绪论第10-13页
    1.1 研究背景和意义第10页
    1.2 数字锁相环的发展以及研究现状第10-12页
    1.3 论文的主要工作和结构安排第12-13页
第二章 数字锁相环概述第13-28页
    2.1 数字锁相环的基本原理第13-14页
        2.1.1 模拟锁相环基本原理第13页
        2.1.2 数字锁相环基本原理第13-14页
    2.2 早期数字锁相环的基本类型第14-18页
        2.2.1 Flip-flop型第14-15页
        2.2.2 Nyquist-rate型第15页
        2.2.3 Lead-lag型第15-16页
        2.2.4 Exclusive-or型第16-17页
        2.2.5 Zero-crossing型第17页
        2.2.6 DTL(Digital Tanlock Loop)型第17-18页
        2.2.7 TDTL(Time-Delay Digital Tanlock Loop)型第18页
    2.3 目前数字锁相环的基本结构类型第18-27页
        2.3.1 鉴相器第19-21页
        2.3.2 数字环路滤波器第21-22页
        2.3.3 数控振荡器第22-23页
        2.3.4 分频器第23-27页
    2.4 本章小结第27-28页
第三章 全数字锁相环的设计和建模分析第28-58页
    3.1 连续域锁相环的模型第28-30页
        3.1.1 连续域锁相环的相位模型第28-30页
        3.1.2 连续域锁相环滤波器的传输函数第30页
    3.2 离散域锁相环的模型第30-31页
    3.3 鉴相器第31-42页
        3.3.1 基于解析滤波器和CORDIC算法的鉴相器原理第31-32页
        3.3.2 解析滤波器第32-40页
        3.3.3 相位获取结构第40-42页
    3.4 相位展开结构第42-44页
    3.5 环路滤波器第44-50页
    3.6 数控振荡器第50-52页
        3.6.1 基于LUT结构的直接数字式频率合成器第50-51页
        3.6.2 基于CORDIC结构的直接数字式频率合成器第51-52页
    3.7 全数字锁相环整体的行为级仿真第52-57页
        3.7.1 行为级模型的建立第52-53页
        3.7.2 LUT结构DDS全数字锁相环的行为级仿真第53-56页
        3.7.3 CORDIC结构DDS全数字锁相环的行为级仿真第56-57页
    3.8 本章小结第57-58页
第四章 全数字锁相环的RTL实现第58-73页
    4.1 基于LUT结构DDS的全数字锁相环的RTL实现第58-67页
        4.1.1 鉴相器的RTL实现与仿真第58-61页
        4.1.2 相位展开结构与环路滤波器的RTL实现第61页
        4.1.3 LUT结构数控振荡器的RTL实现第61-63页
        4.1.4 基于LUT结构DDS的全数字锁相环的整体仿真第63-67页
    4.2 基于CORDIC结构DDS的全数字锁相环的RTL实现第67-72页
        4.2.1 鉴相器的RTL实现与仿真第67-69页
        4.2.2 相位展开结构与环路滤波器的RTL实现第69-70页
        4.2.3 CORDIC结构数控振荡器的RTL实现第70-71页
        4.2.4 基于CORDIC结构DDS的全数字锁相环的整体仿真第71-72页
    4.3 本章小结第72-73页
第五章 全数字锁相环的ASIC设计第73-79页
    5.1 ASIC设计流程简述第73-74页
    5.2 基于CORDIC结构DDS的全数字锁相环的ASIC设计第74-77页
        5.2.1 选取的全数字锁相环结构第74-75页
        5.2.2 ASIC设计过程第75-77页
    5.3 全数字锁相环的后仿真第77-78页
    5.4 本章小结第78-79页
第六章 总结与展望第79-81页
    6.1 工作总结第79页
    6.2 展望第79-81页
致谢第81-82页
参考文献第82-86页
攻读硕士学位期间取得的成果第86-87页

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