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2D转3D中深度图提取的算法研究与硬件实现

摘要第5-6页
Abstract第6-7页
1 绪论第10-13页
    1.1 本文研究的背景与意义第10页
    1.2 深度图提取的研究现状第10-11页
    1.3 本文的章节安排第11-13页
2 深度图提取算法研究与实现第13-27页
    2.1 RGB 转 YUV第13-14页
    2.2 图像调整第14-17页
        2.2.1 双线性插值算法原理介绍第14-16页
        2.2.2 基于双线性插值的图像下采样算法第16-17页
    2.3 运动估计第17-19页
        2.3.1 匹配准则第18-19页
        2.3.2 搜索算法第19页
    2.4 生成深度值第19-20页
    2.5 深度图调整第20-25页
        2.5.1 边缘值提取第21页
        2.5.2 深度图平滑第21-22页
        2.5.3 图像上采样第22-23页
        2.5.4 场景变换度第23-24页
        2.5.5 图像锐化处理第24-25页
    2.6 滤波处理第25-27页
3 深度图提取算法的硬件设计第27-49页
    3.1 深度图提取的硬件设计架构第27-29页
    3.2 顶层接口图第29-30页
    3.3 Apb Slave 模块第30-31页
    3.4 SYNC 模块第31-32页
    3.5 RGB2YUV 模块第32-36页
        3.5.1 RGB2YUV 的计算模块第32-33页
        3.5.2 line buffer 读写模块的设计第33-35页
        3.5.3 输入和输出方式的设计第35-36页
    3.6 图像调整模块第36-38页
    3.7 运动矢量提取模块第38-39页
    3.8 深度值计算模块第39页
    3.9 深度图调整模块第39-45页
        3.9.1 边缘值提取模块的设计第39-40页
        3.9.2 场景变换度模块的设计第40-41页
        3.9.3 平滑模块的设计第41-43页
            3.9.3.1 平滑控制模块第41-42页
            3.9.3.2 平滑计算模块第42-43页
        3.9.4 上采样模块的设计第43-44页
        3.9.5 深度图锐化模块的设计第44-45页
    3.10 滤波模块第45-46页
    3.11 avalon 主机的设计第46-49页
4 深度图提取算法硬件实现的验证第49-56页
    4.1 深度图提取电路的功能验证第49-52页
        4.1.1 功能仿真结果第50-52页
    4.2 深度图提取电路的 FPGA 原型验证第52-56页
        4.2.1 FPGA 原型验证平台的搭建第52-53页
        4.2.2 FPGA 原型验证系统的综合第53-54页
        4.2.3 FPGA 实现第54-56页
5 总结与展望第56-57页
    5.1 全文总结第56页
    5.2 展望第56-57页
参考文献第57-59页
致谢第59-60页
个人简历第60页
发表的学术论文第60-61页

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