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100G以太网PCS子层研究及其在FPGA的实现

摘要第1-6页
ABSTRACT第6-12页
第一章 引言第12-15页
   ·研究目的与意义第12页
   ·国内外研究状况第12-13页
   ·设计目标和主要设计内容第13-14页
     ·设计目标第13页
     ·主要设计内容第13-14页
   ·论文组织结构第14-15页
第二章 高速以太网概述第15-21页
   ·以太网简介第15-16页
   ·以太网优点和发展动向第16-18页
   ·100G 以太网介绍第18-20页
     ·100G 以太网需求第18-19页
     ·100G 以太网发展第19页
     ·100G 以太网关键技术第19-20页
   ·小结第20-21页
第三章 100G 以太网PCS 子层研究第21-34页
   ·100G 以太网体系结构第21-22页
   ·100G 以太网物理层第22-23页
   ·100G 以太网PCS 子层第23-33页
     ·PCS 子层提供的服务第23页
     ·PCS 子层内部功能研究第23-32页
       ·MII 接口第24-25页
       ·64B/66B 编解码第25-29页
       ·100G 以太网数据流扰码第29页
       ·多通道分发核心机制第29-32页
     ·PCS 子层管理第32-33页
   ·小结第33-34页
第四章 100G 以太网PCS 子层设计及实现第34-62页
   ·PCS 子层功能模块划分及简要说明第34页
   ·数据发送模块的设计及实现第34-40页
     ·数据发送模块子模块划分第34-35页
     ·64B/66B 编码模块第35页
     ·100G 数据流扰码模块第35-36页
     ·块分发模块第36-37页
     ·插入对齐字模块第37-40页
       ·方法与步骤第38-39页
       ·BIP 计算处理第39-40页
   ·数据接收模块的设计及实现第40-52页
     ·子模块划分第40-41页
     ·通道块同步模块第41-44页
     ·通道对齐、重排和删除模块第44-49页
       ·方法与步骤第45页
       ·识别虚通道对齐标识码块第45-48页
       ·BIP 校验第48-49页
       ·缓存FIFO第49页
     ·BER 检测模块第49-50页
     ·块解分发模块第50-51页
     ·100GE 数据流解扰模块第51页
     ·64B/66B 解码模块第51-52页
       ·prb_s1_rx_type 子模块第51页
       ·prb_s2_rx_fsm 子模块第51-52页
   ·自同步扰码设计及实现第52-60页
     ·扰码基本原理简介第53页
     ·扰码器分类第53页
     ·自同步扰码第53-55页
     ·并行自同步扰码算法实现第55-58页
     ·100G 以太网扰码方案分析及其设计第58-60页
     ·结论第60页
   ·同步FIFO第60-61页
   ·小结第61-62页
第五章 开发工具简介第62-70页
   ·硬件平台第62-64页
     ·FPGA 简介第62-63页
     ·FPGA 的选择第63-64页
   ·软件介绍第64-66页
     ·QuestaSim 6.3G 验证工具第65页
     ·Xilinx ISE第65-66页
   ·FPGA 设计流程第66-68页
   ·VERILOGHDL 硬件描述语言第68-69页
   ·本章小结第69-70页
第六章 设计结果的验证与仿真第70-84页
   ·测试方案第70-73页
   ·综合资源第73-74页
   ·系统功能的仿真第74-83页
     ·通道块同步模块功能仿真第75-76页
     ·虚通道对齐、重排和删除模块功能仿真第76-77页
     ·块分发和块解分发模块功能仿真第77-78页
     ·插入对齐字模块功能仿真第78-79页
     ·加解扰模块功能仿真第79-81页
     ·64B/66B 编解码模块功能仿真第81-82页
     ·数据流比较第82-83页
   ·小结第83-84页
第七章 结束语第84-86页
   ·结论第84页
   ·进一步的工作方向第84-86页
致谢第86-87页
参考文献第87-90页
攻硕期间取得的成果第90-91页

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