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基于FPGA的RapidIO和万兆以太网路由控制器设计

摘要第4-6页
Abstract第6-7页
英文缩写说明第8-9页
第一章 引言第9-21页
    1.1 研究背景以及意义第9-10页
    1.2 万兆以太网简介第10-14页
        1.2.1 IEEE 802.3ae标准的特征第10-13页
        1.2.2 万兆以太网的应用第13-14页
    1.3 RapidIO简介第14-20页
        1.3.1 RapidIO概述第14-16页
        1.3.2 RapidIO的应用第16-18页
        1.3.3 RapidIO与其他互连技术的比较第18-20页
    1.4 论文的主要内容和结构安排第20-21页
第二章 万兆以太网协议概述第21-27页
    2.1 万兆以太网物理层第21-24页
        2.1.1 物理层简介第21-22页
        2.1.2 物理介质层(PMD)第22-23页
        2.1.3 10GBASE-X的物理层工作原理第23-24页
    2.2 物理层接口第24-27页
        2.2.1 万兆以太网物理层电平接口标准第24-25页
        2.2.2 XGMⅡ接口第25页
        2.2.3 XAUI接口第25-27页
第三章 RapidIO协议概述第27-36页
    3.1 RapidIO技术概要第27-33页
        3.1.1 包与控制符号第27-28页
        3.1.2 包格式第28-29页
        3.1.3 事务格式与类型第29-30页
        3.1.4 消息传递(Message Passing)第30页
        3.1.5 NREAD、NWRITE与消息事务包格式第30-32页
        3.1.6 包开销第32-33页
    3.2 物理层接口第33-36页
        3.2.1 并行物理层第33-34页
        3.2.2 串行物理层第34-35页
        3.2.3 链路协议第35-36页
第四章 万兆以太网与RapidIO路由控制器设计第36-47页
    4.1 功能描述第36-38页
        4.1.1 设计思路第36-37页
        4.1.2 结构框图第37-38页
    4.2 实现方案第38-47页
        4.2.1 用户调度逻辑——RapidIO消息的接收处理第39-40页
        4.2.2 用户调度逻辑——万兆以太网包的接收处理第40-42页
        4.2.3 主要内部模块说明第42-45页
        4.2.4 模块处理数据格式第45-47页
第五章 测试结果与分析第47-54页
    5.1 测试平台第47-49页
        5.1.1 硬件环境第47-48页
        5.1.2 软件环境第48-49页
    5.2 测试内容第49-54页
        5.2.1 万兆以太网包的接收处理第49-51页
        5.2.2 RapidIO邮箱消息的接收处理第51-52页
        5.2.3 寄存器配置读写第52-54页
参考文献第54-55页
附录第55-62页
    附表一 万兆以太网接收转RapidIO模块接口信号描述第55-57页
    附表二 RapidIO转万兆以太网接收模块接口信号描述第57-59页
    附表三 寄存器接口描述(RapidIO转万兆网接收模块中)第59页
    附表四 邮箱维护寄存器描述第59页
    附表五 RapidIO复位第59-60页
    附表六 万兆网控制器维护寄存器描述第60页
    附表七 Mailbox与Mac地址绑定关系(1024组×4)第60-61页
    附表八 物理地址与邮箱地址查找表第61-62页
致谢第62-63页

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