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基于FPGA的LUKS认证芯片电路及其密码恢复方法

摘要第4-5页
Abstract第5页
第一章 绪论第10-14页
    1.1 选题背景及意义第10-11页
    1.2 国内外相关技术现状第11-12页
    1.3 主要研究工作及章节安排第12-14页
第二章 算法原理及LUKS概念第14-36页
    2.1 AES对称密码算法第14-28页
        2.1.1 基于S-box/S~(-1)-box的AES加解密算法第15-21页
        2.1.2 基于T-box/T-1-box的AES加解密算法第21-24页
        2.1.3 密钥扩展算法第24-25页
        2.1.4 AES解密算法三种工作模式第25-28页
    2.2 基于口令的密钥导出函数PBKDF2-HMAC-SHA1第28-31页
        2.2.1 基于口令的密钥导出函数PBKDF2第28-29页
        2.2.2 消息摘要算法HMAC第29页
        2.2.3 哈希算法SHA-1第29-31页
    2.3 反取证算法第31-32页
    2.4 LUKS磁盘技术概述第32-35页
        2.4.1 LUKS加密分区格式分析第32-34页
        2.4.2 LUKS加密解密机制分析第34-35页
    2.5 本章小结第35-36页
第三章 密钥导出函数PBKDF2硬件优化第36-51页
    3.1 SHA-1算法硬件设计第36-41页
        3.1.1 回路展开第38-40页
        3.1.2 预计算第40-41页
    3.2 SHA-1流水线硬件设计第41-45页
        3.2.1 SHA-1流水线结构第41-43页
        3.2.2 SHA-1性能对比分析第43-45页
    3.3 两种PBKDF2硬件优化设计第45-50页
        3.3.1 流水线结构的PBKDF2硬件设计第46-48页
        3.3.2 迭代结构的PBKDF2硬件设计第48-49页
        3.3.3 PBKDF2性能对比分析第49-50页
    3.4 本章小结第50-51页
第四章 AES密码算法硬件优化第51-63页
    4.1 AES-128-ECB电路设计第52-58页
        4.1.1 AES-128-ECB电路结构第52-57页
        4.1.2 AES-128-ECB性能对比分析第57-58页
    4.2 AES-128-CBC解密电路设计第58-60页
        4.2.1 AES-128-CBC电路结构第58-59页
        4.2.2 AES-128-CBC性能对比分析第59-60页
    4.3 AES-256-XTS解密电路设计第60-61页
        4.3.1 AES-256-XTS电路结构第60-61页
        4.3.2 AES-256-XTS性能对比分析第61页
    4.4 本章小结第61-63页
第五章 基于web技术的LUKS密码恢复方法第63-80页
    5.1 LUKS IP核硬件设计第65-70页
        5.1.1 基于流水线结构PBKDF2的LUKS IP核第65-68页
        5.1.2 基于迭代结构PBKDF2的LUKS IP核硬件设计第68-70页
    5.2 基于FreeRTOS的软件应用环境第70-72页
    5.3 实验结果分析第72-79页
    5.4 本章小结第79-80页
第六章 总结与展望第80-82页
    6.1 工作总结第80-81页
    6.2 工作展望第81-82页
参考文献第82-87页
硕士期间取得的成果第87-88页
致谢第88页

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