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兼容DVB-S2X标准的全速率高速LDPC译码器设计与FPGA实现

摘要第5-7页
ABSTRACT第7-8页
符号对照表第11-12页
缩略语对照表第12-16页
第一章 绪论第16-20页
    1.1 研究背景及意义第16-17页
    1.2 国内外研究现状第17-18页
    1.3 论文主要研究内容及结构安排第18-20页
第二章 DVB-S2X标准中LDPC码第20-40页
    2.1 DVB-S2X标准的LDPC码定义第20-26页
        2.1.1 LDPC码的表示方式第20-21页
        2.1.2 DVB-S2X标准LDPC码校验矩阵的构造第21-26页
    2.2 LDPC编码算法第26-31页
        2.2.1 基于LU或RU分解的LDPC编码第27-29页
        2.2.2 DVB-S2X标准LDPC编码算法第29-31页
    2.3 LDPC译码算法第31-38页
        2.3.1 对数域BP算法第33-34页
        2.3.2 最小和算法第34-35页
        2.3.3 改进的最小和算法第35-36页
        2.3.4 LDPC译码算法仿真对比第36-38页
    2.4 多标准兼容性分析第38-39页
    2.5 本章小结第39-40页
第三章 DVB-S2X标准中M-APSK映射解映射第40-50页
    3.1 DVB-S2X标准的M-APSK星座定义第40-43页
    3.2 M-APSK软解映射算法第43-47页
        3.2.1 Log-MAP算法第43-44页
        3.2.2 Max-Log-MAP算法第44页
        3.2.3 Euclidean算法第44页
        3.2.4 Max-Log-MAP简化算法第44-47页
    3.3 DVB-S2X标准中M-APSK软解映射算法对比第47-49页
    3.4 本章小结第49-50页
第四章 新型结构LDPC译码器的设计、实现与测试第50-72页
    4.1 LDPC译码器的参数选择第50-53页
        4.1.1 修正因子大小的选择第50-51页
        4.1.2 LLR信息位宽选择第51-52页
        4.1.3 并行度选择第52-53页
    4.2 新型结构LDPC译码器的设计与实现第53-64页
        4.2.1 高速LDPC译码器整体结构设计第54-57页
        4.2.2 LLR缓存模块第57-59页
        4.2.3 参数控制模块第59-60页
        4.2.4 校验节点更新模块第60-61页
        4.2.5 变量节点更新模块第61-62页
        4.2.6 桶形移位模块第62-64页
        4.2.7 译码输出模块第64页
    4.3 LDPC译码器的实际测试第64-71页
        4.3.1 Modelsim仿真第64-65页
        4.3.2 ISE综合结果和吞吐量对比第65-67页
        4.3.3 FPGA下载测试第67-71页
    4.4 本章小结第71-72页
第五章 总结与展望第72-74页
    5.1 总结第72页
    5.2 展望第72-74页
参考文献第74-78页
附录A第78-80页
致谢第80-82页
作者简介第82-83页

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