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基于FPGA的稀疏神经网络加速器

摘要第5-6页
ABSTRACT第6-7页
第1章 绪论第15-21页
    1.1 课题背景与意义第15-16页
    1.2 国内外研究现状第16-18页
        1.2.1 硬件加速平台第16-17页
        1.2.2 加速器研究现状第17-18页
    1.3 研究内容第18-19页
    1.4 论文的组织安排第19-21页
第2章 相关理论概述第21-31页
    2.1 神经网络基本概念第21-24页
        2.1.1 神经网络基本组成单元第21-22页
        2.1.2 神经网络拓扑结构第22-23页
        2.1.3 神经网络主要计算第23-24页
    2.2 常见的神经网络第24-27页
        2.2.1 深度神经网络第24-25页
        2.2.2 卷积神经网络第25-26页
        2.2.3 长短期记忆网络第26-27页
        2.2.4 二值神经网络第27页
    2.3 稀疏神经网络简介第27-29页
        2.3.1 神经网络剪枝技术第28页
        2.3.2 基于硬件并行度的神经网络剪枝第28-29页
    2.4 本章小结第29-31页
第3章 加速算法的分析第31-41页
    3.1 神经网络预测算法分析第31-34页
        3.1.1 卷积层计算分析第31-33页
        3.1.2 池化层第33-34页
        3.1.3 全连接层第34页
    3.2 计算的迭代分析第34-37页
        3.2.1 卷积层计算的迭代第35-36页
        3.2.2 全连接层计算的迭代第36-37页
    3.3 传统剪枝带来的神经网络模型变化第37-38页
    3.4 改进型剪枝带来的神经网络模型变化第38-40页
    3.5 本章小结第40-41页
第4章 加速器的设计第41-57页
    4.1 基于传统剪枝的稀疏神经网络加速器第41-51页
        4.1.1 加速器整体架构设计第41-42页
        4.1.2 权值参数的处理第42-45页
        4.1.3 计算处理单元的设计第45-47页
        4.1.4 主要优化手段第47-51页
    4.2 基于改进型剪枝的稀疏神经网络加速器第51-56页
        4.2.1 加速器整体架构设计第52-53页
        4.2.2 权值参数的处理第53页
        4.2.3 计算处理单元的设计第53-56页
    4.3 本章小结第56-57页
第5章 实验验证与分析第57-73页
    5.1 实验环境的配置第57-61页
        5.1.1 实验工具简介第57-58页
        5.1.2 实验平台简介第58-59页
        5.1.3 选取的神经网络模型第59-61页
    5.2 传统剪枝的稀疏神经网络加速器性能验证与分析第61-66页
        5.2.1 加速器的性能趋势第62-64页
        5.2.2 与稠密神经网络加速器性能比较第64-66页
    5.3 改进型剪枝的稀疏神经网络加速器性能验证与分析第66-70页
        5.3.1 加速器的性能趋势第66-68页
        5.3.2 与稠密神经网络加速器性能比较第68-70页
    5.4 本章小结第70-73页
第6章 总结与展望第73-75页
    6.1 工作总结第73-74页
    6.2 未来展望第74-75页
参考文献第75-79页
致谢第79-81页
在读期间发表的学术论文与取得的研究成果第81页

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