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高速串行系统建模及自适应模拟均衡器的设计

摘要第4-5页
Abstract第5页
第1章 绪论第9-13页
    1.1 研究背景第9页
    1.2 高速SERDES第9-10页
    1.3 国内外研究现状第10-11页
    1.4 本文的主要内容及结构安排第11-13页
第2章 高速串行通信基础第13-21页
    2.1 信号源第13-14页
    2.2 信道的非理想特性第14-16页
        2.2.1 频率相关性损耗第14-15页
        2.2.2 串扰第15页
        2.2.3 反射第15页
        2.2.4 噪声第15-16页
    2.3 信道传递函数第16-17页
        2.3.1 信道冲激响应第16页
        2.3.2 信道的S参数第16-17页
    2.4 码间干扰与均衡第17-20页
        2.4.1 码间干扰第17页
        2.4.2 信道均衡第17-18页
        2.4.3 奈奎斯特第一准则第18-20页
    2.5 本章小结第20-21页
第3章 高速串行链路建模第21-33页
    3.1 高速串行链路中的均衡技术第21-23页
        3.1.1 高速串行链路结构第21页
        3.1.2 预加重第21-22页
        3.1.3 连续时间线性均衡器第22页
        3.1.4 判决反馈均衡器第22-23页
    3.2 基于MATLAB的预加重和CTLE建模仿真第23-27页
        3.2.1 信道特性第23-24页
        3.2.2 预加重仿真第24-25页
        3.2.3 CTLE仿真第25-27页
    3.3 基于ADS的CTLE+DFE组合均衡器建模第27-31页
        3.3.1 基于ADS的建模第27-28页
        3.3.2 性能评价指标第28页
        3.3.3 建模结果分析第28-31页
        3.3.4 仿真结果总结第31页
    3.4 本章小结第31-33页
第4章 自适应模拟均衡器的设计第33-53页
    4.1 总体结构第33页
    4.2 自适应控制第33-37页
        4.2.1 典型的自适应回路第33-36页
            4.2.1.1 单回路自适应结构第33-35页
            4.2.1.2 双回路自适应结构第35-36页
        4.2.2 本文的自适应结构第36-37页
    4.3 带宽拓展技术第37-40页
        4.3.1 并联峰化技术第37-38页
        4.3.2 有源负反馈技术第38-39页
        4.3.3 电容中和技术第39-40页
    4.4 自适应模拟均衡器的电路设计第40-50页
        4.4.1 均衡滤波器的设计第40-47页
            4.4.1.1 高频补偿滤波器的设计第41-44页
            4.4.1.2 单位增益滤波器设计第44页
            4.4.1.3 乘法器和加法器的设计第44-47页
        4.4.2 自适应回路设计第47-50页
            4.4.2.1 判决器的设计第47-48页
            4.4.2.2 转换时间检测器的设计第48-49页
            4.4.2.3 积分器的设计第49-50页
        4.4.3 输出缓冲电路的设计第50页
    4.5 系统前仿真第50-52页
    4.6 本章小结第52-53页
第5章 自适应模拟均衡器的版图设计第53-61页
    5.1 集成电路版图设计基本技术第53-55页
        5.1.1 叉指晶体管第53页
        5.1.2 对称性与匹配第53页
        5.1.3 噪声第53-54页
        5.1.4 闩锁效应第54-55页
        5.1.5 天线效应第55页
        5.1.6 ESD保护第55页
    5.2 自适应模拟均衡器的版图设计第55-58页
        5.2.1 版图设计的基本流程第55-56页
        5.2.2 自适应模拟均衡器的版图设计第56-57页
        5.2.3 系统后仿真第57-58页
    5.3 芯片测试方案第58-59页
    5.4 本章小结第59-61页
第6章 总结与展望第61-63页
参考文献第63-65页
致谢第65-67页
攻读硕士期间发表的论文第67页

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