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基于FPGA的数据获取电路的研究

摘要第5-6页
Abstract第6页
目录第7-10页
插图索引第10-13页
附表索引第13-14页
第1章 绪论第14-21页
    1.1 课题背景第14-17页
    1.2 读出电子学的发展趋势第17页
    1.3 数据获取电路第17-20页
        1.3.1 数据获取电路的组成第18页
        1.3.2 数据获取电路的发展和现状第18-20页
    1.4 论文主要内容及结构第20-21页
第2章 高速数据获取电路的相关技术第21-33页
    2.1 模数转换技术第21-27页
        2.1.1 ADC 主要类型第21-24页
        2.1.2 ADC 主要性能参数第24-27页
    2.2 高速差分串行传输技术第27-32页
        2.2.1 差分传输第27-28页
        2.2.2 高速串行接口第28-29页
        2.2.3 同步技术第29-32页
    2.3 本章小结第32-33页
第3章 硬件电路设计第33-48页
    3.1 放大电路的设计第33-35页
    3.2 ADC 模数转换电路的设计第35-39页
        3.2.1 AD9257 输入电路设计第36-37页
        3.2.2 AD9257 基准电压源的设计第37页
        3.2.3 AD9257 时钟电路的设计第37-39页
        3.2.4 AD9257 的串行接口电路设计第39页
    3.3 FPGA 数字处理电路第39-44页
        3.3.1 FPGA 芯片的选型第39-40页
        3.3.2 FPGA 与 AD9257 的接口电路第40页
        3.3.3 FPGA 配置电路第40-42页
        3.3.4 FPGA RocketIO 模块第42-44页
            3.3.4.1 GTP 电源设计第42-43页
            3.3.4.2 GTP 电阻校验电路第43页
            3.3.4.3 GTP 时钟设计第43-44页
    3.4 电源电路的设计第44-46页
    3.5 子母板接口电路的设计第46-47页
    3.6 本章小结第47-48页
第4章 PCB 设计第48-53页
    4.1 PCB 元器件布局第48-49页
    4.2 PCB 的叠层结构第49页
    4.3 PCB 的布线第49-52页
        4.3.1 信号完整性第49-50页
            4.3.1.1 信号反射第50页
            4.3.1.2 信号串扰第50页
            4.3.1.3 地弹第50页
        4.3.2 ADC 输出信号布线规则第50-51页
        4.3.3 电源和地线的布线规则第51页
        4.3.4 RocketIO 部分布线规则第51-52页
    4.4 PCB 参考平面分割第52页
    4.5 本章小结第52-53页
第5章 FPGA 固件设计第53-63页
    5.1 基于 ISE 的 FPGA 开发流程第53-54页
    5.2 ADC 与 FPGA 接口设计第54-58页
        5.2.1 串并转换模块第55页
        5.2.2 IODELAY第55-58页
    5.3 RocketIO 模块固件设计第58-62页
    5.4 本章小结第62-63页
第6章 电路调试及性能测试第63-69页
    6.1 硬件调试第63-65页
    6.2 软件调试第65-66页
    6.3 ADC 主要性能指标测试第66-68页
        6.3.1 有效位测试第67页
        6.3.2 积分非线性第67-68页
    6.4 总结第68-69页
结论第69-71页
参考文献第71-74页
附录A 攻读学位期间所发表的学术论文目录第74-75页
附录B 子板管脚定义第75-80页
附录C 电路原理图第80-83页
附录D PCB 版图第83-86页
附录E 8B/10B 编码对应表第86-87页
附录F 有效的控制 K 字符第87-88页
附录G 基于 FPGA 数据获取实物图第88-89页
致谢第89页

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