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千兆高速串行接口集成电路系统设计及其关键技术的研究

声明第1页
论文版权使用授权书第3-4页
摘要第4-5页
Abstract第5-9页
引言第9-15页
 1 对更大带宽的需求第9页
 2 并行接口的限制第9页
 3 高速串行接口第9-10页
 4 高速串行接口系统设计第10-11页
 5 本文的贡献第11-12页
 6 论文的组织第12-15页
第一章 从并行接口到串行接口第15-27页
   ·串行与并行第15页
   ·接口的历史第15-16页
   ·并行的限制第16-19页
   ·串行通讯的基本概念第19-27页
     ·编码方式第19-20页
     ·连接方式第20-21页
     ·传输介质第21-22页
     ·物理接口第22-27页
第二章 高速的串行接口第27-39页
   ·高速串行接口技术第27页
   ·各种高速串行接口标准协议第27-39页
     ·USB2.0 接口第27-30页
     ·IEEE 1394 接口第30-31页
     ·SATA 接口第31-33页
     ·PCI-Express 接口第33-35页
     ·InfiniBand 接口第35-37页
     ·RapidIO 接口第37-39页
第三章 高速串行接口系统设计第39-49页
   ·集成电路的结构化设计方法第39-40页
     ·硬件描述语言HDL第39-40页
     ·基于标准单元的ASIC 设计第40页
   ·高速串行接口协议的分层思想第40-41页
   ·高速串行接口芯片的结构设计第41-49页
     ·系统结构模型第42-45页
     ·模块间接口信号定义第45-47页
     ·应用层协议的实现第47页
     ·应用接口逻辑第47页
     ·串行接口逻辑第47-49页
       ·传输层逻辑第47-48页
       ·数据链路层逻辑第48-49页
第四章 物理层电路第49-59页
   ·物理层电路的基本组成第49-50页
   ·锁相环电路的基本原理与组成第50-53页
   ·模拟电路实现与数字电路实现的分析比较第53-59页
     ·噪声影响第53-54页
     ·面积和功耗第54页
     ·工艺敏感性第54-55页
     ·可测性和系统调试第55页
     ·精度第55页
     ·结构设计和算法第55-56页
     ·冒险竞争第56页
     ·亚稳态第56-59页
第五章 高速串行发送时钟生成电路实现第59-69页
   ·研究现状第59页
   ·全数字锁相环电路实现第59-66页
     ·数控振荡电路第60-62页
     ·相位检测电路第62-63页
     ·环路滤波电路第63-66页
   ·模拟结果第66页
   ·稳定性分析第66-68页
   ·设计总结第68-69页
第六章 系统时钟生成电路实现第69-79页
   ·研究现状第69-70页
   ·基于标准单元的数字实现第70-77页
     ·固定倍频的系统时钟生成电路第70-74页
     ·任意倍数时钟生成电路第74-77页
   ·设计分析第77页
   ·设计总结第77-79页
第七章 高速串行时钟数据恢复方法的研究与实现第79-99页
   ·研究现状第79-81页
   ·两种新的时钟数据恢复方法第81页
   ·“信号边沿补齐”时钟恢复电路第81-88页
     ·算法描述第81-83页
     ·电路结构描述第83-87页
     ·仿真结果第87页
     ·设计分析与比较第87-88页
   ·“串行信号采样自身”数据恢复电路第88-98页
     ·算法描述第89-90页
     ·电路描述第90-94页
     ·仿真结果第94-95页
     ·设计分析与比较第95-96页
     ·原型验证第96-98页
   ·设计总结第98-99页
总结第99-101页
参考文献第101-107页
致谢第107-109页
作者简介第109页

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