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基于多核框架的实时信号并行处理软件研制

摘要第5-6页
Abstract第6-7页
第一章 绪论第11-15页
    1.1 实时信号处理的背景与需求第11-12页
    1.2 实时信号处理的研究现状与发展方向第12-13页
    1.3 多核技术的发展背景与趋势第13-14页
    1.4 论文主要研究内容第14-15页
第二章 任务需求与理论分析第15-27页
    2.1 任务需求综述第15-16页
    2.2 软件功能模块描述与简析第16-21页
        2.2.1 副瓣消除第16-17页
        2.2.2 脉冲调幅第17-18页
        2.2.3 主路滤波第18-19页
        2.2.4 背景采样第19-20页
        2.2.5 杂波图处理第20-21页
        2.2.6 模块描述小结第21页
    2.3 对数据处理性能的理论分析第21-25页
        2.3.1 循环和递归第21-22页
        2.3.2 矩阵乘法第22-23页
        2.3.3 矩阵求逆第23-24页
        2.3.4 傅里叶变换第24-25页
    2.4 本章小结第25-27页
第三章 任务模块性能优化第27-37页
    3.1 模块优化流程介绍第27页
    3.2 模块优化及测试评估第27-32页
        3.2.1 循环第27-28页
        3.2.2 矩阵乘法第28-30页
        3.2.3 矩阵求逆第30-31页
        3.2.4 傅里叶变换第31-32页
        3.2.5 测试评估小结第32页
    3.3 进程与线程第32-33页
        3.3.1 进程、线程介绍第32-33页
        3.3.2 线程优势及线程的选取第33页
    3.4 各功能模块性能测试第33-34页
    3.5 模块重组线程化第34-36页
    3.6 本章小结第36-37页
第四章 内存分配优化第37-47页
    4.1 实时信号处理流程分析第37页
    4.2 线程共享内存第37-39页
        4.2.1 线程同步介绍第37-38页
        4.2.2 线程加锁第38-39页
        4.2.3 锁的选取第39页
    4.3 内存预分配第39-43页
        4.3.1 动态内存预分配介绍第39-40页
        4.3.2 内存预分配第40页
        4.3.3 内存拷贝性能分析第40-41页
        4.3.4 内存预分配性能分析第41-42页
        4.3.5 内存预分配优化前后性能提升测试第42-43页
    4.4 优化内存预分配第43-45页
        4.4.1 内存预分配存在的问题第43页
        4.4.2 优化内存预分配第43-44页
        4.4.3 优化内存预分配前后性能提升测试第44-45页
    4.5 本章小结第45-47页
第五章 线程调度优化及负载均衡第47-59页
    5.1 上下文切换引起的CPU性能降低第47页
    5.2 线程绑核第47-50页
        5.2.1 绑核介绍第47-48页
        5.2.2 绑核操作第48-49页
        5.2.3 绑核性能提升测试第49-50页
    5.3 负载均衡第50页
    5.4 基于静态调度线程分配绑核第50-53页
        5.4.1 NUMA架构第50-51页
        5.4.2 静态调度第51页
        5.4.3 静态调度实现第51-52页
        5.4.4 静态调度性能测试第52-53页
    5.5 动态线程迁移第53-56页
        5.5.1 动态线程迁移介绍第53-54页
        5.5.2 动态迁移算法介绍第54-55页
        5.5.3 动态迁移方案选择第55-56页
    5.6 静态调度+动态迁移结合进行CPU负载均衡第56-57页
    5.7 总体性能测试评估第57-58页
    5.8 本章小结第58-59页
第六章 总结与展望第59-61页
    6.1 总结第59-60页
    6.2 展望第60-61页
致谢第61-63页
参考文献第63-67页
攻读硕士学位期间发表的论文第67页

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