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CMOS宽带分数分频频率综合器的研究与设计

致谢第1-4页
摘要第4-6页
Abstract第6-8页
插图和附表清单第8-12页
目录第12-15页
1 绪论第15-21页
   ·论文研究背景第15-17页
   ·论文的主要工作和创新第17-18页
   ·论文的内容安排第18-21页
2 频率综合器概述和环路分析第21-47页
   ·频率综合器和锁相环概述第21-25页
   ·整数锁相环第25-38页
     ·环路稳定性和瞬态响应第26-31页
     ·环路相位噪声第31-36页
     ·环路带宽与锁定加速第36-38页
       ·周期滑脱(Cycle Slipping)与抑制第36-38页
       ·锁定加速第38页
   ·分数锁相环第38-45页
     ·一阶∑△调制器第40-41页
     ·∑△调制器架构第41-43页
     ·∑△调制器相位噪声第43-45页
   ·本章小结以及锁相环设计规划第45-47页
3 电容电感压控振荡器分析与设计第47-83页
   ·电容电感压控振荡器分析第47-61页
     ·负阻振荡器第47-50页
     ·振荡器噪声第50-56页
     ·变容管与压控振荡器噪声第56-58页
     ·尾电流源噪声第58-61页
   ·宽带LC VCO设计第61-68页
     ·设计考虑第62-66页
     ·设计实例第66-68页
   ·高频压控振荡器MOS版图优化与模型第68-82页
     ·MOS中非本征电容建模概况第69-72页
     ·交叉耦合MOS管版图优化第72页
     ·融合交叉耦合MOS管紧凑模型第72-76页
       ·PSP电荷模型提取第73-74页
       ·互联寄生建模第74-76页
     ·模型验证第76-80页
     ·132GHz push-push VCO设计第80-82页
   ·本章小结第82-83页
4 环路模块分析与设计第83-115页
   ·鉴频鉴相器第83-85页
   ·电荷泵第85-92页
   ·分数分频器第92-108页
     ·双模预分频器加P/S计数器结构第93-95页
     ·基于2/3预分频器级联结构第95-96页
     ·高速D触发器及2/3分频单元第96-101页
       ·真单相位时钟(TSPC)结构第96-99页
       ·电流模式逻辑(CML)结构第99-101页
     ·多模分频器电路设计第101-106页
     ·分数分频器第106-108页
   ·输出除2~n分频器第108-109页
   ·环路带宽恒定技术第109-113页
   ·本章小结第113-115页
5 自动频率校准第115-135页
   ·传统自动频率校准第116-120页
     ·采样比较第116-119页
     ·子带搜索第119-120页
   ·校准方法的优化第120-128页
     ·对VCO频率直接计数第120-123页
     ·子带预选第123-125页
     ·最优子带搜索第125-126页
     ·自适应计数精度第126-127页
     ·分数误差控制第127-128页
   ·AFC设计第128-133页
   ·本章小结第133-135页
6 芯片设计实例和测试第135-153页
   ·系统设计第135-136页
   ·模块设计第136-142页
     ·宽带压控振荡器第136-137页
     ·鉴频鉴相器、电荷泵第137-138页
     ·多模分频器第138-139页
     ·输出分频器第139页
     ·数字模块设计与实现第139-142页
     ·输入输出单元第142页
   ·整体版图设计与实现第142-143页
   ·测试与验证第143-152页
     ·开环VCO测试第145页
     ·整数分频测试第145-147页
     ·分数分频测试第147-148页
     ·AFC测试第148-149页
     ·输出分频器测试第149-151页
     ·测试小结第151-152页
   ·本章小结第152-153页
7 总结与展望第153-155页
   ·工作总结第153-154页
   ·展望第154-155页
参考文献第155-161页
博士期间科研成果第161页

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