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系统芯片中的全数字锁相环设计

摘要第1-5页
Abstract第5-7页
第一章 绪论第7-10页
   ·本课题研究背景第7-8页
   ·本文的主要工作和意义第8-9页
   ·论文的结构第9-10页
第二章 锁相环概述第10-26页
   ·锁相环简介第10-17页
   ·全数字锁相环第17-22页
   ·锁相环的应用和性能参数第22-25页
   ·本章小结第25-26页
第三章全数字锁相环前端设计第26-39页
   ·全数字锁相环的的系统设计第26-30页
   ·鉴相器的设计第30-32页
   ·数控振荡器的设计第32-36页
   ·数字滤波器的设计第36页
   ·可编程分频器的设计第36-37页
   ·总体电路的联调第37-38页
   ·本章小结第38-39页
第四章 全数字锁相环的后端设计第39-45页
   ·后端流程的选择第39-40页
   ·后端设计第40-44页
   ·全数字锁相环IP 核的建立第44页
   ·本章小结第44-45页
第五章 锁相环的后仿真与测试第45-53页
   ·仿真结果第45-48页
   ·测试结果第48-52页
   ·本章小结第52-53页
第六章 总结与展望第53-55页
致谢第55-56页
参考文献第56-58页
作者简介第58页

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