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基于FPGA的数字延时/脉冲发生器的研制

摘要第4-5页
Abstract第5-6页
第1章 绪论第11-16页
    1.1 研究背景及意义第11-12页
    1.2 国内外研究现状第12-14页
    1.3 主要研究内容第14-16页
第2章 延时/脉冲发生器总体方案设计第16-25页
    2.1 需求分析第16-17页
    2.2 设计方案论证第17-23页
        2.2.1 FPGA延时链技术方案第17-19页
        2.2.2 电流积分技术方案第19-21页
        2.2.3 电容二次充电技术方案第21-23页
    2.3 延时/脉冲发生器总体设计第23-24页
    2.4 本章小结第24-25页
第3章 延时/脉冲发生器硬件设计第25-45页
    3.1 触发信号整形电路设计第25-27页
    3.2 数字延时电路设计第27-33页
        3.2.1 FPGA芯片选型第27-28页
        3.2.2 Flash存储电路及下载调试电路第28-29页
        3.2.3 时钟电路及复位电路第29页
        3.2.4 自触发模式逻辑电路第29-31页
        3.2.5 外触发模式逻辑电路第31-33页
    3.3 模拟延时电路设计第33-34页
        3.3.1 D/A电路第33页
        3.3.2 斜坡电路第33-34页
    3.4 串口通讯电路与输出驱动电路设计第34-35页
    3.5 NiosII软核单片机设计第35-37页
        3.5.1 NiosII介绍第35-36页
        3.5.2 NiosII软核构建第36-37页
    3.6 人机交互电路设计第37-40页
        3.6.1 主控芯片选型第38页
        3.6.2 下载调试电路第38-39页
        3.6.3 功能按键、旋钮及蜂鸣器电路第39-40页
        3.6.4 液晶显示电路第40页
    3.7 电源设计第40-41页
    3.8 硬件制作第41-43页
        3.8.1 主控板PCB制作第42-43页
        3.8.2 人机交互电路PCB制作第43页
        3.8.3 整机实物展示第43页
    3.9 本章小结第43-45页
第4章 延时/脉冲发生器软件设计第45-56页
    4.1 NiosII程序总体设计第45-47页
    4.2 NiosII子程序设计第47-50页
        4.2.1 Flash控制程序第47-48页
        4.2.2 PIO控制程序第48-49页
        4.2.3 DAC7565控制程序第49页
        4.2.4 NiosII串口控制程序第49-50页
    4.3 人机交互程序总体设计第50-51页
    4.4 人机交互子程序设计第51-54页
        4.4.1 液晶控制程序第51-53页
        4.4.2 菜单程序设计第53-54页
        4.4.3 旋钮程序设计第54页
    4.5 本章小结第54-56页
第5章 校准及测试应用第56-66页
    5.1 校准方法设计第56页
    5.2 延时/脉冲发生器参数测试第56-61页
        5.2.1 测试平台第56-57页
        5.2.2 外触发抖动测试第57-59页
        5.2.3 自触发抖动测试第59-60页
        5.2.4 上升沿与延时分辨率测试第60页
        5.2.5 其它参数测试第60-61页
    5.3 在飞行时间二次离子质谱仪中的应用第61-63页
    5.4 在激光诱导击穿光谱仪器中的应用第63-65页
    5.5 本章小结第65-66页
第6章 全文总结第66-67页
    6.1 主要工作总结第66页
    6.2 下一步工作建议第66-67页
参考文献第67-71页
作者简介及科研成果第71-72页
致谢第72页

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