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用AES加密保护数据的双处理器MP3 SoC系统

摘要第1-6页
ABSTRACT第6-11页
第一章 绪论第11-15页
   ·MP3 播放器的发展趋势第11-13页
   ·本课题的意义和价值第13-14页
   ·本文结构安排第14-15页
第二章 基础技术和算法简介第15-35页
   ·FAT 文件系统第15-20页
     ·分区表(Partition Table Block)第15-16页
     ·参数块(BIOS Parameter Block)第16-17页
     ·文件描述表(File Description Table)第17-18页
     ·文件分配表(File Allocation Table)第18-20页
   ·AES 密码算法第20-30页
     ·数学基础第20页
     ·AES 加解密流程第20-24页
       ·加密流程第20-21页
       ·解密流程第21页
       ·加解密流程图第21-24页
     ·轮操作分解第24-30页
       ·字节替换(ByteSub)第24-25页
       ·反字节替换(Inv-ByteSub)第25-26页
       ·移行(ShiftRow)第26-27页
       ·反移行(Inv-ShiftRow)第27页
       ·混列(MixColumn)第27-28页
       ·反混列(Inv-MixColumn)第28页
       ·轮密钥混合(AddRoundKey)第28页
       ·反轮密钥混合(Inv-AddRoundKey)第28-29页
       ·密钥扩展(KeyExpansion)第29-30页
   ·JPEG 文件格式第30-35页
     ·定义量化表(Define Quantization Table)第32页
     ·定义霍夫曼表(Define Huffman Table)第32-33页
     ·基线模式帧开始(Start Of Frame, Baseline)第33页
     ·扫描开始(Start of Scan)第33-34页
     ·定义重新开始间隔(Define Restart Interval)第34页
     ·应用定义数据(Application Specific Data)第34-35页
第三章 系统总体介绍第35-40页
   ·系统总体架构第35-37页
     ·时钟域第36页
     ·总线第36-37页
   ·系统主要模块介绍第37-38页
   ·系统主要应用流程第38-40页
第四章 硬件模块的设计第40-55页
   ·防冲突存储控制器第40-45页
     ·防冲突控制锁(semaphore)第40-41页
     ·存储器的物理分块第41-43页
     ·存储器的地址转换第43-45页
   ·分数时钟分频器第45-47页
     ·ICG 的介绍第45-46页
     ·分数产生计数器第46-47页
   ·高速多功能 DMA第47-52页
     ·主要特点和功能第48-49页
     ·运作流程第49-52页
   ·不同频同相位时钟域间的数据传输第52-55页
     ·快时钟域到慢时钟域的传输第52-53页
     ·慢时钟域到快时钟域的传输第53-54页
     ·应用局限性和注意问题第54-55页
第五章 软件模块的设计第55-67页
   ·软件的三种模式第55-56页
   ·启动代码第56-57页
   ·省电睡眠和唤醒流程第57-59页
     ·省电睡眠第57-59页
     ·唤醒第59页
   ·存储器编址第59-61页
     ·程序存储器编址第59-60页
     ·数据存储器编址第60-61页
   ·文件系统管理第61-63页
     ·电脑端操作系统管理第62页
     ·芯片内部软件管理第62-63页
   ·文件加解密管理第63-65页
     ·文件加密的目的第63页
     ·密钥的管理第63-64页
     ·加密流程第64-65页
     ·解密流程第65页
   ·主程序流程第65-67页
第六章 结论与总结第67-70页
   ·本课题的主要工作内容第67页
   ·设计中的困难及总结第67-68页
   ·本课题的实际意义及展望第68-70页
致谢第70-71页
参考文献第71-73页

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