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基于C*CoreTMRISC CPU的FLASH控制器设计

摘要第1-4页
Abstract第4-6页
第一章 绪论第6-11页
 第一节 课题研究背景第6-8页
 第二节 本论文选题的意义与目的第8-9页
 第三节 本课题研究的内容第9-11页
第二章 控制器的硬件实现第11-20页
 第一节 NAND Flash Memory接口描述第11-13页
 第二节 芯片控制器硬件描述第13-17页
 第三节 芯片与NAND Flash Memory的连接方式第17-20页
第三章 系统架构及总体设计第20-23页
 第一节 系统架构简介第20-22页
 第二节 控制器软件架构第22-23页
第四章 物理驱动接口层设计第23-31页
 第一节 NAND Flash Memory物理存储结构第23-26页
 第二节 NAND Flash Memory固有特性驱动接口第26-29页
 第三节 NAND Flash Memory特性指令驱动接口第29-31页
第五章 软件逻辑管理层算法设计第31-40页
 第一节 逻辑管理层简述第31-32页
 第二节 管理模式第32-35页
 第三节 平衡算法第35-37页
 第四节 块替换第37-39页
 第五节 无效块回收第39-40页
第六章 控制器性能、优化及向后兼容方法设计第40-47页
 第一节 控制器实物图片第40-42页
 第二节 控制器性能测试第42-44页
 第三节 控制器固件优化简介第44-45页
 第四节 向后兼容设计第45-47页
第七章 控制器应用量产简述第47-51页
 第一节 应用量产的方式第47-49页
 第二节 专用工具量产流程简介第49-51页
第八章 总结与展望第51-53页
参考文献第53-54页
致谢第54-55页

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