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高速数字电路同时开关噪声时域分析

摘要第5-6页
ABSTRACT第6-7页
符号对照表第11-12页
缩略语对照表第12-15页
第一章 绪论第15-21页
    1.1 同时开关噪声引起原因第15-17页
    1.2 电源完整性、信号完整性和电磁完整性协同设计第17-18页
    1.3 课题研究的主要内容第18-19页
    1.4 论文组织结构第19-21页
第二章 电源分配网络结构分析第21-31页
    2.1 稳压器第22-23页
    2.2 去耦电容器第23-26页
    2.3 PCB和封装电源地平面第26-27页
    2.4 3D芯片堆叠电源分配网络第27-30页
        2.4.1 硅通孔第28-29页
        2.4.2 电源地网格第29页
        2.4.3 焊点和微焊点第29-30页
    2.5 本章小结第30-31页
第三章 同时开关噪声建模第31-45页
    3.1 同时开关噪声和信号返回电流第31-33页
        3.1.1 分支串行端接逻辑信号电流回路分析第31-32页
        3.1.2 伪漏极开路的信号电流回路分析第32-33页
    3.2 SSN建模分析第33-38页
        3.2.1 驱动器的建模第33-34页
        3.2.2 非理想互连的建模第34-38页
    3.3 电源分配网络建模第38-41页
        3.3.1 芯片外电源分配网络模型第39-40页
        3.3.2 3D芯片堆叠电源分配网络模型第40-41页
    3.4 单元化电源地网格建模方法第41-42页
    3.5 本章小结第42-45页
第四章 同时开关噪声时域分析第45-61页
    4.1 阻抗函数第45-49页
        4.1.1 阻抗函数的矢量拟合第46-48页
        4.1.2 多芯片阻抗函数第48-49页
    4.2 开关电流的建模第49-52页
    4.3 SSN时域解析式计算和分析第52-54页
    4.4 实例验证分析第54-59页
    4.5 本章小结第59-61页
第五章 总结与展望第61-63页
参考文献第63-67页
致谢第67-69页
作者简介第69-70页

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