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一种高速低功耗流水线ADC的设计

摘要第5-6页
ABSTRACT第6页
第一章 绪论第10-15页
    1.1 研究课题的选题依据第10页
    1.2 本课题的研究意义第10-11页
    1.3 国内外研究现状和发展趋势第11-15页
第二章 ADC的基本架构和性能指标第15-26页
    2.1 相关的ADC架构第15-20页
        2.1.1 Flash ADC第15-16页
        2.1.2 两步式ADC第16-17页
        2.1.3 流水线ADC第17-18页
        2.1.4 时间交织ADC第18-19页
        2.1.5 (?)ADC第19-20页
    2.2 ADC的性能指标第20-25页
        2.2.1 静态参数第20-23页
            2.2.1.1 分辨率第21-22页
            2.2.1.2 微分非线性误差(DNL)和差分非线性误差(INL)第22-23页
            2.2.1.3 失调误差和增益误差第23页
        2.2.2 动态参数第23-25页
            2.2.2.1 SNR第23页
            2.2.2.2 ENOB第23-24页
            2.2.2.3 SFDR和THD第24-25页
        2.2.3 品质因数(FOM,Figure Of Merit)第25页
    2.3 本章小结第25-26页
第三章 基本原理分析和校正算法第26-42页
    3.1 流水线ADC的基本组成部分第26-34页
        3.1.1 T/H电路第26-29页
            3.1.1.1 沟道电荷注入第28页
            3.1.1.2 时钟馈通效应第28-29页
        3.1.2 Sub ADC电路第29-30页
        3.1.3 MDAC电路第30-34页
            3.1.3.1 运算放大器电路第30-32页
            3.1.3.2 MDAC电路第32-34页
    3.2 流水线架构的误差分析和校正原理第34-41页
        3.2.1 电容失配第34-35页
        3.2.2 运算放大器的非线性第35-36页
        3.2.3 运算放大器的失调误差第36页
        3.2.4 比较器的失调误差第36-38页
        3.2.5 闭环增益误差和运放的有限增益误差第38-39页
        3.2.6 后台校正算法第39-41页
    3.3 本章小结第41-42页
第四章 电路设计和仿真结果第42-55页
    4.1 整体架构的设计第42-43页
    4.2 各个模块的设计和仿真第43-52页
        4.2.1 时钟电路第43-45页
        4.2.2 T/H电路第45-47页
        4.2.3 开关电容比较器第47页
        4.2.4 运放第47-51页
        4.2.5 第一级电路仿真第51-52页
        4.2.6 延时单元和编码电路第52页
    4.3 ADC的整体仿真结果第52-54页
        4.3.1 动态仿真结果第52-53页
        4.3.2 静态仿真结果第53-54页
    4.4 本章小结第54-55页
第五章 版图设计与后仿第55-65页
    5.1 版图的整体架构第55-57页
    5.2 小线宽版图设计中值得注意的地方第57-59页
        5.2.1 STI效应第57-58页
        5.2.2 WPE效应第58页
        5.2.3 对称设计第58-59页
    5.3 重要模块的后仿第59-62页
        5.3.1 T/H电路第60-61页
        5.3.2 运放第61-62页
    5.4 整体电路的后仿第62-64页
    5.5 本章小结第64-65页
第六章 结论第65-66页
致谢第66-67页
参考文献第67-71页

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