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基于RISC核的无损音频解码软硬件协同优化方法

致谢第4-5页
摘要第5-6页
Abstract第6-7页
目录第8-10页
图表索引第10-12页
中英文对照第12-13页
1 绪论第13-21页
    1.1 研究背景第13-14页
    1.2 相关研究第14-16页
        1.2.1 音频编解码算法第14-15页
        1.2.2 损音频编码格式第15-16页
    1.3 硬件模拟器第16-18页
    1.4 RISC32处理器第18-19页
    1.5 论文内容安排和贡献第19-21页
2 APE编解码算法第21-41页
    2.1 APE编解码算法概述第21-23页
        2.1.1 APE编码概述第21-22页
        2.1.2 APE解码概述第22-23页
    2.2 APE编码核心算法第23-39页
        2.2.1 神经网络预测编码算法第24-28页
        2.2.2 熵编码算法第28-39页
    2.3 本章小结第39-41页
3 无损音频解码算法软件优化第41-63页
    3.1 相关研究第42-43页
    3.2 APE解码算法应用特性分析第43-48页
    3.3 APE解码算法优化第48-52页
        3.3.1 熵解码算法优化第48-50页
        3.3.2 神经网络预测解码算法优化第50-52页
    3.4 实验方法第52-57页
        3.4.1 实验环境第52-54页
        3.4.2 性能计数器第54-57页
    3.5 实验结果第57-61页
        3.5.1 性能分析第57-60页
            3.5.1.1 熵解码优化第57-59页
            3.5.1.2 神经网络预测解码优化第59-60页
        3.5.2 功耗第60-61页
    3.6 本章小结第61-63页
4 基于RISC核的音频解码硬件优化第63-85页
    4.1 相关研究第64-65页
    4.2 处理器微体系结构优化第65-74页
        4.2.1 乘累加模块第65-68页
        4.2.2 除法模块第68-71页
        4.2.3 Cache写机制第71-74页
    4.3 实验方法第74-75页
        4.3.1 实验环境第74-75页
    4.4 实验结果第75-84页
        4.4.1 性能分析第75-82页
            4.4.1.1 乘累加模块优化第75-77页
            4.4.1.2 除法模块优化第77-78页
            4.4.1.3 Cache写机制优化第78-80页
            4.4.1.4 处理器微体系结构优化的扩展性第80-82页
        4.4.2 硬件开销第82-83页
        4.4.3 功耗第83-84页
    4.5 本章小结第84-85页
总结与展望第85-87页
参考文献第87-91页
作者攻读硕士期间参加科研工作的情况第91页

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