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数据传输中同步技术研究及高速接口设计实现

摘要第5-6页
ABSTRACT第6页
符号对照表第10-11页
缩略语对照表第11-14页
第一章 绪论第14-18页
    1.1 课题研究背景及意义第14页
    1.2 同步研究现状第14-16页
    1.3 本文主要工作与安排第16-18页
第二章 MPSK信号同步技术研究第18-42页
    2.1 MPSK信号模型第18-20页
    2.2 锁相环理论基础第20-23页
        2.2.1 锁相环工作原理第20-21页
        2.2.2 鉴相器第21-22页
        2.2.3 环路滤波器第22-23页
        2.2.4 压控振荡器第23页
    2.3 Costas环的基本结构及工作原理第23-31页
        2.3.1 数字鉴相器的设计第24-27页
        2.3.2 环路滤波器的设计第27-30页
        2.3.3 数字振荡器(NCO)的设计第30-31页
    2.4 基于锁相环的Gardner位同步算法研究第31-36页
        2.4.1 Gardern算法原理第31-32页
        2.4.2 内插滤波器第32-33页
        2.4.3 定时误差检测器第33-35页
        2.4.4 环路滤波器第35页
        2.4.5 数控振荡器第35-36页
    2.5 基于Gardner环辅助的Costas环载波同步仿真第36-40页
        2.5.1 系统框图第36-37页
        2.5.2 仿真结果及分析第37-40页
    2.6 本章小结第40-42页
第三章 CPM信号同步研究第42-58页
    3.1 CPM信号模型第42-43页
    3.2 GMSK信号原理第43-46页
    3.3 GMSK信号的载波同步研究第46-52页
        3.3.1 最大似然估计准则第46-48页
        3.3.2 数据辅助频偏估计思想第48页
        3.3.3 Kay频偏估计算法第48-49页
        3.3.4 Fitz频偏估计算法第49页
        3.3.5 L&R频偏估计算法第49-50页
        3.3.6 GMSK信号载波频率估计第50-52页
    3.4 GMSK信号的位同步研究第52-56页
        3.4.1 同步序列第52-54页
        3.4.2 同步性能仿真第54-56页
    3.5 本章小结第56-58页
第四章 基于FPGA高速传输接.的设计第58-74页
    4.1 以太网介绍第58页
    4.2 网络接口芯片第58-61页
    4.3 MAC层功能的实现第61-69页
        4.3.1 MAC IP核介绍第61-63页
        4.3.2 IP核接.介绍第63页
        4.3.3 发送通道第63-65页
        4.3.4 接收通道第65-66页
        4.3.5 IP核的复位操作和PHY管理(MDIO)第66-68页
        4.3.6 寄存器配置第68-69页
    4.4 千兆网.的实现第69-74页
        4.4.1 独立程序模块的介绍第69-73页
        4.4.2 传输数据验证第73页
        4.4.3 本章小结第73-74页
第五章 总结与展望第74-76页
参考文献第76-78页
致谢第78-80页
作者简介第80-81页

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