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TD-SCDMA系统下行码片级处理的研究与实现

摘要第1-4页
Abstract第4-8页
第一章 绪论第8-18页
   ·课题背景及发展现状第8-15页
     ·第三代移动通信系统的概念第8-10页
     ·TD-SCDMA的技术特点第10-13页
     ·TD-SCDMA在中国的发展现状及演进方向第13-15页
   ·课题研究意义第15-16页
   ·课题任务及论文结构第16-18页
第二章 TD-SCDMA物理层第18-26页
   ·TD-SCDMA物理层概述第18-19页
     ·多址接入方案第18页
     ·信道编码方案第18页
     ·调制和扩频方案第18-19页
     ·物理层过程第19页
   ·TD-SCDMA物理信道第19-24页
     ·物理信道第19-20页
     ·帧结构第20-22页
     ·时隙结构第22-24页
   ·本章小结第24-26页
第三章 TD-SCDMA下行码片级处理的实现第26-36页
   ·TD-SCDMA下行码片级处理的实现方法第26-30页
     ·TD-SCDMA下行码片级处理流程第26-27页
     ·TD-SCDMA下行码片级处理平台第27-30页
   ·TD-SCDMA下行码片级处理的整体结构第30-35页
     ·符号级数据处理电路第30-31页
     ·下行时隙数据处理时间定标第31-32页
     ·待调制符号数据存取第32-33页
     ·跨时钟域转换异步FIFO第33-35页
   ·本章小结第35-36页
第四章 数据域处理模块的FPGA设计及仿真第36-56页
   ·常规码道符号级数据处理电路第36-51页
     ·待调制符号级数据第37-38页
     ·数据调制第38-40页
     ·扩频处理第40-42页
     ·加扰处理第42-43页
     ·数据域码片定标第43-44页
     ·常规码道处理控制电路第44-51页
   ·E-HICH码道数据处理第51-53页
     ·E-HICH概念第51-52页
     ·E-HICH码道数据处理电路第52-53页
   ·输出控制电路第53-54页
   ·本章小结第54-56页
第五章 训练序列处理模块的FPGA设计及仿真第56-66页
   ·Midamble码生成过程第56-58页
   ·训练序列码片定标第58-59页
   ·Midamble码移位处理第59-62页
     ·Midamble码的相关数据分时读取控制电路第60-61页
     ·Midamble码移位处理电路第61-62页
   ·Midamble码加权处理电路第62-64页
   ·本章小结第64-66页
第六章 下行导频时隙处理模块的FPGA设计及仿真第66-72页
   ·下行导频码处理过程第66-67页
   ·下行导频码片定标第67-68页
   ·下行导频码相关数据分时读取控制第68-70页
   ·下行导频码天线加权处理第70-71页
   ·本章小结第71-72页
第七章 天线加权模块的FPGA设计及仿真第72-84页
   ·天线加权原理第72-75页
     ·智能天线的基本概念第72-73页
     ·智能天线的基本原理第73-75页
   ·数据读取控制电路第75-78页
     ·天线加权运算的时钟第75-76页
     ·天线加权运算数据读取第76-78页
   ·乘累加电路第78-80页
     ·乘累加电路结构第78-79页
     ·FPGA所用IP CORE第79-80页
   ·chip对齐FIFO第80-82页
     ·常规时隙chip对齐FIFO第80-81页
     ·下行导频时隙chip对齐FIFO第81-82页
   ·本章小结第82-84页
第八章 系统整合及板级验证第84-92页
   ·仿真第84页
   ·FPGA资源占用第84-85页
   ·在线验证第85-88页
   ·输出天线IQ数据频谱第88-91页
   ·本章小结第91-92页
第九章 总结与展望第92-94页
致谢第94-96页
参考文献第96-98页
研究成果第98-99页
附录A 16QAM modulation map第99-100页
附录B 64QAM modulation map第100-103页

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