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低延迟自组织网的网络层FPGA设计与实现

摘要第5-6页
ABSTRACT第6页
第一章 绪论第13-16页
    1.1 研究背景及意义第13页
    1.2 研究内容与主要贡献第13-14页
    1.3 论文结构与章节安排第14-16页
第二章 无线自组织网技术现状第16-24页
    2.1 引言第16页
    2.2 数据传输的信道接入技术第16-20页
        2.2.1 自组织网接入面临的问题第17-18页
        2.2.2 常见自组织网络接入协议及其传输时延第18-20页
    2.3 常见时间同步算法简介第20-23页
        2.3.1 基于发送者广播的时间同步算法第21页
        2.3.2 基于接收者-接收者交互的时间同步算法第21-22页
        2.3.3 基于发送者-接收者交互的时间同步算法第22-23页
    2.4 小结第23-24页
第三章 低延迟自组织网络需求与分析第24-30页
    3.1 应用场景第24-25页
        3.1.1 全网时间同步第24页
        3.1.2 IP化数据传输第24-25页
    3.2 设计约束第25-28页
        3.2.1 硬件系统简介第26-27页
        3.2.2 物理层链路简介第27-28页
    3.3 设计目标第28-29页
    3.4 小结第29-30页
第四章 低延迟自组织网方案设计第30-50页
    4.1 网络层总体方案设计第30-31页
    4.2 以太网接第31-34页
    4.3 广播通道方案设计第34-41页
        4.3.1 网络层帧结构第34页
        4.3.2 网络拓扑维护流程第34-36页
        4.3.3 时钟同步方案第36-40页
        4.3.4 广播通道碰撞概率分析第40-41页
    4.4 数据通道方案设计第41-44页
        4.4.1 网络层帧结构第41-42页
        4.4.2 MAC帧与物理层帧的转换第42-43页
        4.4.3 MAC帧路由第43-44页
    4.5 收发切换方案设计第44-49页
        4.5.1 基于竞争的收发切换第45-46页
        4.5.2 基于TDMA子网的收发切换第46-47页
        4.5.3 收发切换模式转换方案第47-49页
    4.6 小结第49-50页
第五章 网络层FPGA实现第50-80页
    5.1 广播通道第50-61页
        5.1.1 总体结构框图第50-51页
        5.1.2 子模块FPGA实现第51-61页
    5.2 数据通道第61-68页
        5.2.1 总体结构框图第61-62页
        5.2.2 子模块FPGA实现第62-68页
    5.3 收发切换第68-75页
        5.3.1 竞争模式下的收发切换控制第68-73页
        5.3.2 子网模式下的收发切换控制第73-75页
    5.4 配置和上报第75-79页
        5.4.1 链路配置第75-78页
        5.4.2 信息上报第78-79页
    5.5 资源消耗分析第79页
    5.6 小结第79-80页
第六章 测试与结果分析第80-93页
    6.1 两节点AD/DA回环测试第80-88页
        6.1.1 测试场景第80-81页
        6.1.2 节点入网时间测试第81页
        6.1.3 时间同步精度测试第81-83页
        6.1.4 数据传输测试第83-88页
    6.2 多节点无线传输测试第88-92页
        6.2.1 测试场景第88-89页
        6.2.2 时间同步精度测试第89-91页
        6.2.3 数据传输测试第91-92页
    6.3 小结第92-93页
第七章 结束语第93-95页
    7.1 本文总结及主要贡献第93页
    7.2 下一步工作的建议第93-95页
致谢第95-96页
参考文献第96-98页
个人简历第98-99页
攻硕期间取得的研究成果第99-100页
学位论文评审后修改说明表第100-101页
学位论文答辩后勘误修订说明表第101-102页

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