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eMMC主机控制器设计与研究

摘要第5-6页
abstract第6-7页
第一章 绪论第11-15页
    1.1 背景与意义第11页
    1.2 国内外研究现状第11-13页
    1.3 工作内容和论文结构第13-15页
第二章 eMMC协议介绍第15-31页
    2.1 eMMC结构第15-16页
    2.2 内部寄存器第16-17页
    2.3 工作模式第17-21页
        2.3.1 引导操作模式第17-19页
        2.3.2 设备识别模式第19-20页
        2.3.3 中断模式第20页
        2.3.4 数据传输模式第20-21页
        2.3.5 无效模式第21页
    2.4 命令与响应第21-24页
        2.4.1 命令格式第21-22页
        2.4.2 响应格式第22-23页
        2.4.3 时序第23-24页
    2.5 数据传输第24-29页
        2.5.1 数据传输格式第24-27页
        2.5.2 读数据时序第27-28页
        2.5.3 写数据时序第28-29页
    2.6 命令排队功能第29-30页
    2.7 本章总结第30-31页
第三章 AMBA协议简介第31-37页
    3.1 APB协议第31-33页
        3.1.1 总线接口第31页
        3.1.2 传输时序第31-33页
    3.2 AXI协议第33-36页
        3.2.1 总线接口第33-35页
        3.2.2 传输时序第35-36页
    3.3 本章总结第36-37页
第四章 eMMC主机控制器设计第37-59页
    4.1 整体架构第37-38页
    4.2 时钟管理模块第38-40页
    4.3 APB接口第40-41页
    4.4 内部DMA第41-44页
    4.5 乒乓RAM第44-45页
    4.6 命令响应模块第45-48页
        4.6.1 自动命令功能第45-46页
        4.6.2 命令发送第46-47页
        4.6.3 响应接收第47-48页
    4.7 数据控制模块第48页
    4.8 数据传输模块第48-52页
        4.8.1 数据写传输第48-50页
        4.8.2 数据读传输第50-51页
        4.8.3 HS400读传输第51页
        4.8.4 数据流第51-52页
    4.9 命令排队控制模块第52-57页
        4.9.1 任务读取模块第52-55页
        4.9.2 任务执行模块第55-56页
        4.9.3 任务管理模块第56页
        4.9.4 命令发送模块第56-57页
    4.10 中断控制第57-58页
    4.11 本章总结第58-59页
第五章 验证与分析第59-74页
    5.1 仿真环境第59-61页
        5.1.1 eMMC设备模型第59-60页
        5.1.2 AXI从机第60页
        5.1.3 APB主从机第60-61页
    5.2 寄存器读写验证第61页
    5.3 命令响应传输验证第61-64页
        5.3.1 无响应命令第61页
        5.3.2 48位响应命令第61-62页
        5.3.3 忙状态响应命令第62-63页
        5.3.4 136位响应命令第63页
        5.3.5 自动发送命令第63-64页
    5.4 数据传输验证第64-68页
        5.4.1 SDR模式单块数据传输第64-66页
        5.4.2 SDR模式多块数据读写第66-67页
        5.4.3 DDR模式数据传输第67-68页
        5.4.4 HS400模式传输第68页
    5.5 命令排队功能验证第68-70页
    5.6 DMA传输验证第70-71页
    5.7 引导操作验证第71页
    5.8 综合与分析第71-73页
        5.8.1 逻辑综合第71-72页
        5.8.2 静态时序分析第72-73页
        5.8.3 形式验证第73页
    5.9 本章总结第73-74页
总结与展望第74-76页
参考文献第76-79页
攻读硕士学位期间取得的研究成果第79-80页
致谢第80-81页
附件第81页

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