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高效视频编码算法的CUDA优化

摘要第5-6页
ABSTRACT第6-7页
符号对照表第11-12页
缩略语对照表第12-15页
第一章 绪论第15-19页
    1.1 研究背景第15页
    1.2 国内外研究现状第15-17页
    1.3 本文研究内容第17-18页
    1.4 论文结构安排第18-19页
第二章 HEVC编码器简述第19-37页
    2.1 编码结构简述第19-22页
        2.1.1 编码单元第20-21页
        2.1.2 预测单元第21-22页
        2.1.3 变换单元第22页
    2.2 预测编码技术第22-25页
        2.2.1 帧内预测编码第23-24页
        2.2.2 帧间预测第24-25页
    2.3 MV预测技术第25-27页
    2.4 整像素运动估计第27-31页
    2.5 分像素插值第31-33页
    2.6 分像素运动搜索第33页
    2.7 率失真第33-36页
    2.8 本章小结第36-37页
第三章 GPU简介与CUDA架构第37-45页
    3.1 CUDA硬件架构简述第37-39页
    3.2 CUDA软件架构简述第39-42页
    3.3 存储器第42-44页
        3.3.1 寄存器第42-43页
        3.3.2 局部存储器第43页
        3.3.3 共享存储器第43页
        3.3.4 全局存储器第43页
        3.3.5 常数存储器第43页
        3.3.6 纹理存储器第43-44页
    3.4 本章小结第44-45页
第四章 HEVC运动估计算法的CUDA优化第45-67页
    4.1 HM框架分析及运动估计算法流程第45-47页
    4.2 整像素运动估计的CUDA优化第47-55页
        4.2.1 优化思路第47-53页
        4.2.2 整像素运动估计的CUDA优化实现第53页
        4.2.3 优化结果第53-55页
    4.3 分像素插值的CUDA优化第55-60页
        4.3.1 优化思路及实现第55-59页
        4.3.2 优化结果第59-60页
    4.4 分像素运动搜索的的CUDA优化第60-63页
        4.4.1 优化思路及实现第60-62页
        4.4.2 优化结果第62-63页
    4.5 其余部分的CUDA优化第63-65页
        4.5.1 率失真估算的CUDA优化第63-64页
        4.5.2 MVP修正第64-65页
    4.6 本章小结第65-67页
第五章 HEVC多线程系统优化设计第67-77页
    5.1 多线程机制第67-68页
    5.2 系统设计及CPU多线程优化改进第68-71页
    5.3 整体系统性能分析第71-76页
    5.4 本章小结第76-77页
第六章 总结和展望第77-79页
参考文献第79-83页
致谢第83-85页
作者简介第85-86页

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