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支持可重构的流接口的设计与实现

目录第3-5页
图目录第5-6页
表目录第6-7页
摘要第7-8页
Abstract第8-9页
第1章 绪论第10-13页
    1.1 研究背景第10页
    1.2 研究的目的与意义第10-11页
    1.3 主要研究内容及章节安排第11-13页
        1.3.1 国内外研究概况第11页
        1.3.2 本文主要工作第11-12页
        1.3.3 论文结构第12-13页
第2章 可重构技术简介第13-17页
    2.1 可重构计算的概念第13页
    2.2 可重构计算系统的主要特征第13-14页
    2.3 可重构系统的分类第14-16页
        2.3.1 系统耦合方式第14-15页
        2.3.2 可重构单元粒度第15页
        2.3.3 系统重构方式第15-16页
    2.4 本章小结第16-17页
第3章 流接口的设计与实现第17-46页
    3.1 基于FPGA的嵌入式系统设计第17-21页
        3.1.1 基于FPGA的嵌入式系统硬件设计第19-20页
            3.1.1.1 基于XUP Virtex-5的硬件架构第19页
            3.1.1.2 基于MicroBlaze的嵌入式微处理器第19-20页
        3.1.2 基于FPGA的嵌入式系统软件开发第20-21页
            3.1.2.1 嵌入式系统软件开发概述第20-21页
            3.1.2.2 基于SDK的嵌入式系统软件开发第21页
    3.2 基于FPGA的流接口设计第21-44页
        3.2.1 基于总线的流接口第22-30页
            3.2.1.1 PLB总线第22-23页
            3.2.1.2 基于PLB总线的IP开发流程第23-24页
            3.2.1.3 基于PLB总线的流接口的硬件设计第24-29页
            3.2.1.4 基于PLB总线的流接口的软件设计第29-30页
        3.2.2 基于LocalLink和DMA的流接口第30-44页
            3.2.2.1 LocalLink协议第31-32页
            3.2.2.2 基于LocalLink的流接口第32-39页
            3.2.2.3 基于LocalLink的流接口的软件设计第39-41页
            3.2.2.4 MPMC的基本介绍第41-42页
            3.2.2.5 基于SDMA的流接口第42-44页
    3.3 本章小结第44-46页
第4章 可重构IP的设计与开发第46-55页
    4.1 动态部分重构技术第46-47页
    4.2 动态部分重构设计方法第47-48页
        4.2.1 基于模块的设计第47-48页
        4.2.2 基于差异的设计第48页
        4.2.3 基于比特流的设计第48页
        4.2.4 基于EAPR的设计第48页
        4.2.5 基于PR的设计第48页
    4.3 动态部分重构设计专业术语第48-49页
    4.4 动态部分重构开发流程第49-50页
    4.5 重构模块的开发第50-53页
        4.5.1 DES加/解密第50-51页
        4.5.2 AES加/解密第51-53页
        4.5.3 DCT第53页
    4.6 本章小结第53-55页
第5章 支持可重构的流接口系统的设计与实现第55-63页
    5.1 支持可重构的流接口系统的设计第55-56页
    5.2 支持互连重构的交叉开关第56页
    5.3 实验结果第56-60页
        5.3.1 基本模式第57-58页
        5.3.2 流水线模式第58-59页
        5.3.3 数据并行模式第59-60页
    5.4 实验总结第60-62页
        5.4.1 基本模式第60-61页
        5.4.2 流水线模式第61-62页
        5.4.3 数据并行模式第62页
    5.5 本章小结第62-63页
第6章 总结与展望第63-65页
    6.1 工作总结第63-64页
    6.2 工作展望第64-65页
参考文献第65-68页
致谢第68-69页
攻读硕士学位期间的科研工作第69-70页

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