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基于多核处理器串行程序并行化改造和性能优化

摘要第1-7页
Abstract第7-11页
第1章 绪论第11-19页
   ·引言第11页
   ·本课题的研究背景第11-14页
     ·多核的研究现状和发展第11-13页
     ·多核的应用领域第13页
     ·课题的研究现状第13-14页
     ·课题的研究意义第14页
   ·本课题的并行化模型工具第14-16页
     ·并行模型TBB第15页
     ·并行支持工具Intel工具第15-16页
   ·本设计的预期目标和主要工作内容第16-18页
     ·预期目标第16页
     ·主要工作内容第16-17页
     ·课题的难点第17-18页
     ·课题的创新点第18页
   ·本章小结第18-19页
第2章 系统总体设计第19-25页
   ·多核开发平台第19-20页
     ·硬件开发平台-多核处理器第19-20页
     ·软件开发平台第20页
     ·系统验证平台第20页
   ·总体设计第20-24页
     ·系统分析第21页
     ·并行化开发运行时库的选择第21-22页
     ·并行化开发工具的选择第22-23页
     ·系统开发模型的建立第23-24页
     ·系统开发步骤第24页
   ·本章小结第24-25页
第3章 串行程序可并行化分析第25-38页
   ·串行程序的结构特征第25-31页
     ·串行程序总体架构第25-27页
     ·串行程序的功能第27-29页
     ·串行程序的并行化条件第29-30页
     ·串行程序的并行化可能性第30-31页
   ·Vtune性能分析解决方案第31-33页
     ·Vtune采样分析第31-33页
     ·Vtune调用图分析第33页
   ·串行程序的并行化分析第33-36页
     ·串行程序的存储结构第34-35页
     ·串行程序的循环并行化分析第35页
     ·串行程序的任务级别划分分析第35-36页
   ·串行程序的并行化分析总体解决方案第36-37页
   ·本章小结第37-38页
第4章 并行化改造的设计实现第38-58页
   ·传统解决方案第38-39页
     ·Raw thread解决方案第38页
     ·OpenMP解决方案第38-39页
   ·开发平台第39-41页
     ·TBB介绍第39-40页
     ·并行环境构建第40-41页
     ·并行设计模型整体架构第41页
   ·流程机制的并行化改造实现第41-46页
     ·TBB/pipeline流程机制设计第42-45页
     ·TBB/filter设计第45-46页
   ·粒度划分和循环并行化实现第46-53页
     ·parallel_for循环并行化设计第47-50页
     ·blocked_range/blocked_range2d并行粒度划分设计第50-51页
     ·粒度的划分实验第51-53页
   ·内存并行化设计第53-54页
   ·任务级并行化实现第54-55页
     ·TBB/scheduler_init任务调度设计第54-55页
     ·TBB/task设计第55页
   ·并行时间计时实现第55-56页
   ·并行结果和性能初步评测第56-57页
   ·并行结果分析第57页
   ·本章小结第57-58页
第5章 并行化程序调试和优化第58-70页
   ·优化程序多核平台的建立第58-59页
   ·调试第59-63页
     ·Checker分析第59-61页
     ·数据竞争问题的解决方案第61-63页
   ·Intel C++Complier编译优化第63-65页
     ·Intel C++Complier对串行程序的优化第64页
     ·complier c++对并行程序的优化第64-65页
   ·Intel thread profiler优化第65-69页
     ·profiler分析第65-67页
     ·负载均衡的解决方案第67-68页
     ·加锁解锁性能影响的解决方案第68-69页
   ·本章小结第69-70页
第6章 分析结果总评测第70-74页
   ·与串行程序的对比评测第70-72页
   ·对评测结果的分析第72-73页
   ·本章小结第73-74页
结论第74-76页
致谢第76-77页
攻读硕士学位期间发表的论文第77-78页
参考文献第78-83页

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