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全数字QPSK载波同步研究及FPGA实现

中文摘要第4-5页
Abstract第5-6页
第1章 绪论第10-16页
    1.1 论文研究的背景和意义第10-12页
    1.2 国内外研究现状第12-14页
        1.2.1 SDR的研究和发展现状第12-13页
        1.2.2 载波同步的研究和发展现状第13-14页
    1.3 本文的主要研究内容第14-15页
    1.4 本文的组织结构第15-16页
第2章 数字接收机的理论知识第16-44页
    2.1 信号的采样定理第16-20页
    2.2 数字滤波器第20-21页
    2.3 QPSK调制解调原理第21-26页
    2.4 载波同步技术概述第26-29页
    2.5 几种常见的载波同步算法第29-40页
    2.6 载波同步算法的性能分析第40-42页
    2.7 本章小结第42-44页
第3章 载波同步环路的设计第44-67页
    3.1 系统的总体设计第44-45页
    3.2 环路主要模块的设计第45-58页
        3.2.1 鉴相器的设计第45-48页
        3.2.2 环路滤波器的设计第48-55页
        3.2.3 NCO振荡器的设计第55-58页
    3.3 成形与匹配滤波器的设计第58-61页
    3.4 环路的性能分析第61-66页
    3.5 本章小结第66-67页
第4章 载波同步环路的MATLAB仿真第67-84页
    4.1 发射机的MATLAB仿真第67-71页
        4.1.1 基带信号模块的仿真第67-69页
        4.1.2 成形滤波器模块的仿真第69页
        4.1.3 NCO模块的仿真第69-70页
        4.1.4 QPSK调制模块的仿真第70-71页
    4.2 接收部分的MATLAB仿真第71-83页
        4.2.1 A/D转换模块的仿真第71-72页
        4.2.2 QPSK解调模块的仿真第72-74页
        4.2.3 NCO模块的仿真第74-77页
        4.2.4 鉴相器模块的仿真第77-78页
        4.2.5 环路滤波器模块的仿真第78-80页
        4.2.6 匹配滤波模块的仿真第80-83页
    4.3 本章小结第83-84页
第5章 载波同步环路的FPGA实现第84-104页
    5.1 系统开发环境简介第84-86页
        5.1.1 开发工具简介第84页
        5.1.2 HDL语言简介第84-85页
        5.1.3 硬件测试工具第85-86页
    5.2 数字发射机的FPGA实现第86-91页
        5.2.1 基带信号模块第86-87页
        5.2.2 成形滤波器模块第87-89页
        5.2.3 QPSK调制模块第89-91页
    5.3 数字接收机的FPGA实现第91-103页
        5.3.1 本地NCO模块第92-94页
        5.3.2 混频器模块第94-96页
        5.3.3 积分和累加模块第96-98页
        5.3.4 鉴相器模块第98-99页
        5.3.5 环路滤波器模块第99-101页
        5.3.6 匹配滤波器模块第101-103页
    5.4 本章小结第103-104页
结论第104-106页
参考文献第106-112页
致谢第112-113页
攻读硕士学位期间发表的学术论文第113-114页
攻读硕士学位期间参加的科研项目第114-115页
攻读硕士学位期间取得的科研成果第115页

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